參數(shù)資料
型號: ICS93716BGLF
廠商: IDT, Integrated Device Technology Inc
文件頁數(shù): 1/13頁
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描述: IC DDR PLL CLOCK DRIVER 28-TSSOP
標(biāo)準(zhǔn)包裝: 48
類型: 時鐘緩沖器/驅(qū)動器
PLL:
主要目的: 存儲器,DDR
輸入: 時鐘
輸出: 時鐘
電路數(shù): 1
比率 - 輸入:輸出: 2:6
差分 - 輸入:輸出: 無/是
頻率 - 最大: 233MHz
電源電壓: 2.3 V ~ 2.7 V
工作溫度: 0°C ~ 85°C
安裝類型: 表面貼裝
封裝/外殼: 28-TSSOP(0.240",6.10mm 寬)
供應(yīng)商設(shè)備封裝: 28-TSSOP
包裝: 管件
其它名稱: 93716BGLF
Integrated
Circuit
Systems, Inc.
ICS93716
0420H—09/10/08
Block Diagram
Low Cost DDR Phase Lock Loop Clock Driver
Pin Configuration
28-Pin SSOP and TSSOP
Recommended Application:
DDR Clock Driver
Product Description/Features:
Low skew, low jitter PLL clock driver
I
2C for functional and output control
Feedback pins for input to output synchronization
Spread Spectrum tolerant inputs
Bypass mode on B revision only
Switching Characteristics:
PEAK - PEAK jitter (66MHz): <75ps
CYCLE - CYCLE jitter (>100MHz):<65ps
OUTPUT - OUTPUT skew: <100ps
Output Rise and Fall Time: 550ps - 950ps
Functionality
S
T
U
P
N
IS
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FB_INT
FB_INC
CLK_INC
CLK_INT
SCLK
SDATA
Control
Logic
FB_OUTT
FB_OUTC
CLKT0
CLKT1
CLKT2
CLKT3
CLKT4
CLKT5
CLKC0
CLKC1
CLKC2
CLKC3
CLKC4
CLKC5
PLL
CLKC0
CLKT0
VDD
CLKT1
CLKC1
GND
SCLK
CLK_INT
CLK_INC
VDDA
GND
VDD
CLKT2
CLKC2
GND
CLKC5
CLKT5
CLKC4
CLKT4
VDD
SDATA
FBINC
FBINT
FB_OUTT
FB_OUTC
CLKT3
CLKC3
GND
ICS93716
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PDF描述
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