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參數(shù)資料
| 型號： | ICS9160M-03 |
| 元件分類： | 時鐘產(chǎn)生/分配 |
| 英文描述： | 80 MHz, PROC SPECIFIC CLOCK GENERATOR, PDSO32 |
| 封裝： | SOIC-32 |
| 文件頁數(shù)： | 6/7頁 |
| 文件大小： | 240K |
| 代理商： | ICS9160M-03 |
6
ICS9160-03
Preliminary Product Preview
The data is latched into the internal shift register on the falling edge of the BCLK signal with the BCLK as a reference
(see waveform above). The SDATA input pattern will change at the BCLK rising edges and must be stable for loading into
the shift register at the BCLK falling edges.
Programming Bit Addresses
The following table lists the function of each of the 15 input programming bits for the device.
ICS9160-03 SDATA Serial Stop Clock Input Pin Bit Pattern
BIT#
OUTPUT PIN
STOP CLOCK FUNCTION
(Clocks stops if Bit=Low)
0
START BIT (One "zero" bit needed to start shift register sequence.)
132
GRAPHIC
2n/a
330
FLOPPY
4
28
BCLK6
5
27
BCLK5
6
21
BCLK4
7
22
BCLK3
8
24
BCLK2
9
25
BCLK1
10
19
BCLK0
11
n/a
12
PCLK3
13
11
PCLK2
14
9
PCLK1
15
8
PCLK0
相關(guān)PDF資料 |
PDF描述 |
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