參數(shù)資料
型號(hào)： ICS844S42BKILF
廠商： IDT, Integrated Device Technology Inc
文件頁數(shù)： 24/27頁
文件大?。?/td> 0K
描述： IC SYNTHESIZER RF FREQ 56-VFQFPN
標(biāo)準(zhǔn)包裝： 260
系列： HiPerClockS™
類型： 頻率合成器
PLL： 帶旁路
輸入： LVCMOS，LVTTL，晶體
輸出： LVDS，LVPECL
電路數(shù)： 1
比率 - 輸入:輸出： 2:2
差分 - 輸入:輸出： 無/是
頻率 - 最大： 2.592GHz
除法器/乘法器： 是/無
電源電壓： 3.135 V ~ 3.465 V
工作溫度： -40°C ~ 85°C
安裝類型： 表面貼裝
封裝/外殼： 56-VFQFN 裸露焊盤
供應(yīng)商設(shè)備封裝： 56-VFQFP-EP（8x8）
包裝： 托盤
其它名稱： 844S42BKILF
ICS844S42BKI REVISION A FEBRUARY 21, 2012
6
2012 Integrated Device Technology, Inc.
ICS844S42I Data Sheet
DUAL OUTPUT RF FREQUENCY SYNTHESIZER
Example Output Frequency Configuration
If a single reference frequency of 16MHz is available, an output
frequency at QA of 2500MHz and a small frequency granularity is
desired, the following steps would be taken to identify the
appropriate P, M, and N configuration:
1. Use Table 3A to select the output divider, NA, that matches the
desired output frequency or frequency range. According to Table 3A
a target output frequency of 2500MHz falls in the fOUT range of
1296MHz to 2592MHz and requires to set NA = 1.
2. Calculate the VCO frequency fVCO = fOUT NA, which is 2500MHz
in this example.
3. Determine the PLL feedback divider: M = fVCO ÷ P. The smallest
possible output granularity in this example calculation is 4MHz (set P
= 4). M calculates to a value of 2500MHz ÷ 4 = 625MHz.
4. Configure the ICS844S42I with the obtained settings:
M[9:0] = 1001110001b (binary number for M = 625)
NA[2:0] = 000 (÷1 divider, see Table 3C)
P = 1 (÷4 divider, see Table 3B)
NB[2:0] = 111 will stop (disable) the QB output
5. Use either parallel or serial interface to apply the setting.
The I2C configuration byte for this examples are:
0x00 = 01110001b, 0x01 = 10111000b and 0x02 = 10000000b. See
Table 3H for a register map.
PLL Divider Configuration
Table 3B. Pre-Divider (P) Table
Table 3C. Post-Divider (Nx) Table
P
Pre-Divider P
Operation
02
fPD = fREF ÷ 2
1 (default)
4
fPD = fREF ÷ 4
NA, NB
Post-Divider
NA, NB
Operation
21
0
0 (default)
1
fQA, fQB = fVCO ÷ 1
00
1
2
fQA, fQB = fVCO ÷ 2
01
0
3
fQA, fQB = fVCO ÷ 3
01
1
6
fQA, fQB = fVCO ÷ 6
10
0
4
fQA, fQB = fVCO ÷ 4
10
1
8
fQA, fQB = fVCO ÷ 8
11
0
16
fQA, fQB = fVCO ÷ 16
1
N/A
Output stopped in logic low state
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PDF描述
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參數(shù)描述
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