參數(shù)資料
型號(hào)： ICS8430S07AKILFT
廠商： IDT, Integrated Device Technology Inc
文件頁數(shù)： 3/26頁
文件大?。?/td> 0K
描述： IC CLK GENERATOR PLL 32VFQFN
標(biāo)準(zhǔn)包裝： 2,500
類型： 時(shí)鐘/頻率發(fā)生器，扇出緩沖器（分配），多路復(fù)用器
PLL： 是
主要目的： Cavium 處理器
輸入： LVCMOS，LVDS，LVPECL，LVTTL，SSTL，晶體
輸出： LVCMOS，LVPECL，LVTTL
電路數(shù)： 1
比率 - 輸入:輸出： 2:7
差分 - 輸入:輸出： 是/是
頻率 - 最大： 133.33MHz
電源電壓： 3.135 V ~ 3.465 V
工作溫度： -40°C ~ 85°C
安裝類型： 表面貼裝
封裝/外殼： 32-VFQFN 裸露焊盤
供應(yīng)商設(shè)備封裝： 32-VFQFN（5x5）
包裝： 帶卷 (TR)
ICS8430S07AKI REVISION A SEPTEMBER 3, 2009
11
2009 Integrated Device Technology, Inc.
ICS8430S07I Data Sheet
CLOCK GENERATOR FOR CAVIUM PROCESSORS
Parameter Measurement Information, continued
LVCMOS Bank Skew
LVPECL Cycle-to-Cycle Jitter
RMS Phase Jitter
LVCMOS Part-to-Part Skew
LVCMOS Cycle-to-Cycle Jitter
Output Rise/Fall Time
tsk(b)
V
DDO_REF
2
V
DDO_REF
2
QREF[0:2]
tcycle n
tcycle n+1
tjit(cc) =
|tcycle n – tcycle n+1|
1000 Cycles
QA
nQA
Phase Noise Mask
Offset Frequency
f
1
f
2
Phase Noise Plot
RMS Jitter = Area Under the Masked Phase Noise Plot
Noise
P
o
w
er
tsk(pp)
V
DDO_REF
2
V
DDO_REF
2
Par t 1
Par t 2
Q_REFx
Q_REFy
V
DDOX
2
V
DDOX
2
V
DDOX
2
tcycle n
tcycle n+1
tjit(cc) =
|tcycle n – tcycle n+1|
1000 Cycles
QB:QD,
QREF[0:2]
20%
80%
20%
tR
t F
VSWING
QA:QD,
QREF[0:2]
nQA
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PDF描述
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