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參數資料
| 型號： | ICS8430S07AKILFT |
| 廠商： | IDT, Integrated Device Technology Inc |
| 文件頁數： | 12/26頁 |
| 文件大?。?/td> | 0K |
| 描述： | IC CLK GENERATOR PLL 32VFQFN |
| 標準包裝： | 2,500 |
| 類型： | 時鐘/頻率發(fā)生器，扇出緩沖器（分配），多路復用器 |
| PLL： | 是 |
| 主要目的： | Cavium 處理器 |
| 輸入： | LVCMOS，LVDS，LVPECL，LVTTL，SSTL，晶體 |
| 輸出： | LVCMOS，LVPECL，LVTTL |
| 電路數： | 1 |
| 比率 - 輸入:輸出： | 2:7 |
| 差分 - 輸入:輸出： | 是/是 |
| 頻率 - 最大： | 133.33MHz |
| 電源電壓： | 3.135 V ~ 3.465 V |
| 工作溫度： | -40°C ~ 85°C |
| 安裝類型： | 表面貼裝 |
| 封裝/外殼： | 32-VFQFN 裸露焊盤 |
| 供應商設備封裝： | 32-VFQFN（5x5） |
| 包裝： | 帶卷 (TR) |
ICS8430S07AKI REVISION A SEPTEMBER 3, 2009
2
2009 Integrated Device Technology, Inc.
ICS8430S07I Data Sheet
CLOCK GENERATOR FOR CAVIUM PROCESSORS
Block Diagram
25MHz
CLK
nCLK
PLL
OSC
nPLL_SEL
1
0
1
0
25MHz
XTAL_IN
XTAL_OUT
0 = 50.000MHz
1 = 33.333MHz
00 = 133.333MHz
01 = 100.000MHz
10 = 83.333MHz
11 = 125.000MHz
Processor Core Clock
(LVCMOS)
DDR533, DDR400, or
DDR667 Reference
Clock (LVPECL)
125MHz GbE CLK
25MHz GbE CLK
00 = 133.333MHz
01 = 100.000MHz
10 = 66.667MHz
11 = 33.333MHz
PCI or PCI-X Clock
(LVCMOS)
Gigabit Ethernet MAC
Clock (LVCMOS)
\
\ Gigabit Ethernet
/ PHY Clocks
/ (LVCMOS)
nXTAL_SEL
QB
QA
nQA
QC
QD
QREF0
QREF1
QREF2
CORE_SEL
DDR_SEL1:0
PCI_SEL1:0
Clock Output
Control Logic
MR/nOE_REF
PD
PU/PD
PD
相關PDF資料 |
PDF描述 |
|---|---|
| VI-23B-MY-S | CONVERTER MOD DC/DC 95V 50W |
| D38999/26JJ29PC | CONN PLUG 29POS STRAIGHT W/PINS |
| MS27508E18B35PB | CONN RCPT 66POS BOX MNT W/PINS |
| VI-234-MY-S | CONVERTER MOD DC/DC 48V 50W |
| VI-233-MY-S | CONVERTER MOD DC/DC 24V 50W |
相關代理商/技術參數 |
參數描述 |
|---|---|
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