參數(shù)資料
型號(hào)： ICS670M-03ILFT
廠商： IDT, Integrated Device Technology Inc
文件頁(yè)數(shù)： 5/7頁(yè)
文件大?。?/td> 0K
描述： IC BUFFER/MULTIPLIER ZD 16-SOIC
標(biāo)準(zhǔn)包裝： 2,500
系列： ClockBlocks™
類型： 時(shí)鐘同步器，零延遲緩沖器
PLL： 是
輸入： 時(shí)鐘
輸出： CMOS
電路數(shù)： 1
比率 - 輸入:輸出： 1:1
差分 - 輸入:輸出： 無(wú)/無(wú)
頻率 - 最大： 210MHz
除法器/乘法器： 無(wú)/是
電源電壓： 3 V ~ 5.5 V
工作溫度： -40°C ~ 85°C
安裝類型： 表面貼裝
封裝/外殼： 16-SOIC（0.154"，3.90mm 寬）
供應(yīng)商設(shè)備封裝： 16-SOIC
包裝： 帶卷 (TR)
其它名稱： 670M-03ILFT
ICS670-03
LOW PHASE NOISE ZERO DELAY BUFFER AND MULTIPLIER
ZDB AND MULTIPLIER
IDT / ICS LOW PHASE NOISE ZERO DELAY BUFFER AND MULTIPLIER 5
ICS670-03
REV J 051310
Figure 1. Skew from ICLK to CLK2, with change in load capacitance (VDD = 3.3V)
Adjusting Input/Output Skew
The data in Figure 1 can be used to adjust individual circuit characteristics and achieve the minimum possible skew
between ICLK and CLK2. With a 125 MHz output, for example, having a total load capacitance of 15 pF will result
in nearly zero skew between ICLK and CLK2. Note that the load
capacitance includes board trace capacitance, input capacitance of the load being driven by the ICS670-03, and
any additional capacitors connected to CLK2.
Figure 2. Phase Noise at 125 MHz out, 25 MHz clock input (VDD = 3.3V)
-400
-300
-200
-100
0
100
200
300
25
50
75
100
125
150
CLK2 Frequency (MHz)
Skew
(p
s)
Skew (ps) 20 pF
Skew (ps) 10 pF
ICS670 Phase noise
-140
-120
-100
-80
-60
-40
-20
0
10.E+0
100.E+0
1.E+3
10.E+3
100.E+3
1.E+6
10.E+6
offset frequency
L
(f)
d
B
c
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PDF描述
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參數(shù)描述
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