參數(shù)資料
型號： ICS1524M
英文描述： Dual Output Phase Controlled SSTL-3/PECL Clock Generator
中文描述： 雙輸出相控SSTL-3/PECL時鐘發(fā)生器
文件頁數(shù)： 3/24頁
文件大?。?/td> 394K
代理商： ICS1524M
3
I
I
B
ICS1524 Block Diagram
June 25, 2001
Charge
Pump
Phase/
Freq
Detector
VCO
Post-
Scaler
Divider
EXTFIL (8)
Ref_Pol
Reg 0:2
HSYNC
(7)
EXTFB
(6)
MUX
Fbk_Sel
Reg 0:4
DPACLK+ (21)
DPACLK– (20)
OE-Pck
Reg 6:0
DPACLK (17)
FUNC (15)
I
2
C
Interface
Power-
On
Reset
SCL
(4)
SDA
(3)
CLK+ (23)
CLK– (22)
MUX
Func_Sel
Reg 0:5
CLK (16)
MUX
0
OSC
(12)
Osc
Divider
XFILRET (9)
I
2
CADR
(13)
Lock
Logic
PECL
Bias
IREF
(24)
Int Filter
LOCK/REF (14)
Filter
Select
DPA_Lock
Reg 12:0
PFD
Reg 1:0-2
PLL_Lock
Reg 12:1
En_DLS
Reg 0:7
En_PLS
Reg 0:6
PD_Pol
Reg 0:1
Osc_Div
Reg 7:0-6
PSD
Reg 1:4-5
Fil_Sel
Reg 4:7
DPA_OS
Reg 4:0-5
Reg
OE_F
Reg 6:4
6
:
OE_P2
Reg 2
Reg
OE_T2
6:3
OE_Tck
Reg 6:1
Feedback
Divider
FDB0
2:0-7
FDB1
Reg: 3:0-3
Fbk_Pol
Reg 0:3
DPA_Res
Reg 5:0-1
1
0
1
0
1
+
+
Dynamic
Phase
Adjust
PDEN (5)
Ck2_Inv
Reg 6:5
MUX
0
1
Output
Scaler
Out_Scl
Reg 6:6-7
PDen
Reg 0:0
相關(guān)PDF資料
PDF描述
ICS1524MT Dual Output Phase Controlled SSTL-3/PECL Clock Generator
ICS1526 Video Clock Synthesizer
ICS1526GLF Video Clock Synthesizer
ICS1526GLFTR Video Clock Synthesizer
ICS1531 Triple 8-bit MSPS A/D Converters with Line-Locked Clock Generator
相關(guān)代理商/技術(shù)參數(shù)
參數(shù)描述
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ICS1526 制造商:ICS 制造商全稱:ICS 功能描述:Video Clock Synthesizer
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ICS1526GILFT 功能描述:IC VIDEO CLK SYNTHESIZER 16TSSOP RoHS:是 類別:集成電路 (IC) >> 時鐘/計時 - 時鐘發(fā)生器，PLL，頻率合成器 系列:- 標準包裝:1,000 系列:- 類型:時鐘/頻率合成器，扇出分配 PLL:- 輸入:- 輸出:- 電路數(shù):- 比率 - 輸入:輸出:- 差分 - 輸入:輸出:- 頻率 - 最大:- 除法器/乘法器:- 電源電壓:- 工作溫度:- 安裝類型:表面貼裝 封裝/外殼:56-VFQFN 裸露焊盤 供應商設備封裝:56-VFQFP-EP（8x8） 包裝:帶卷 (TR) 其它名稱:844S012AKI-01LFT
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