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參數(shù)資料
| 型號： | HM66AEB9405BP-60 |
| 英文描述： | HM66AEB36105/HM66AEB18205 HM66AEB9405 Datasheet |
| 中文描述： | HM66AEB36105/HM66AEB18205 HM66AEB9405數(shù)據(jù)表 |
| 文件頁數(shù)： | 13/32頁 |
| 文件大?。?/td> | 251K |
| 代理商： | HM66AEB9405BP-60 |
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HM66AEB36102/18202/9402
Rev.0.0, Dec. 2002, page 11 of 30
(HM66AEB9402)
Operation
K
K
BW
Write D0 to D8
L
→
H
L
→
H
L
→
H
L
→
H
0
0
Write nothing
1
Notes: 1. H: high level, L: low level,
→
: rising edge.
2. Assumes a WRITE cycle was initiated.
BW
can be altered for any portion of the burst WRITE
operation provided that the setup and hold requirements are satisfied.
1
Bus Cycle State Diagram
LOAD NEW
ADDRESS
Count = 0
WRITE DOUBLE
Count = Count + 2
READ DOUBLE
Count = Count + 2
LD
= L,
Count = 2
LD
= L,
Count = 2
LD
= H,
Count = 2
LD
= H,
Count = 2
NOP
POWER UP
Supply voltage provided
LD
= H
LD
= L
R/
W
= L
R/
W
= H
Notes: 1. SA0 is internally advanced in accordance with the burst order table. Bus cycle is terminated after
burst count = 2.
2. State machine control timing sequence is controlled by K.
相關(guān)PDF資料 |
PDF描述 |
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參數(shù)描述 |
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| HM66AQB18202BP-60 | 制造商:未知廠家 制造商全稱:未知廠家 功能描述:HM66AQB36102/HM66AQB18202 HM66AQB9402 Datasheet |
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