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參數(shù)資料
| 型號(hào)： | HD4074654S |
| 廠商： | Hitachi,Ltd. |
| 英文描述： | 4-Bit Single-Chip Microcomputer |
| 中文描述： | 4位單片機(jī) |
| 文件頁數(shù)： | 72/109頁 |
| 文件大?。?/td> | 430K |
| 代理商： | HD4074654S |
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HD404654 Series
72
Transfer completion
(IFS1 1)
Interrupts inhibited
IFS1 0
SM1A write
IFS1 = 1
Transmit clock
error processing
Normal
termination
Yes
No
Transmit clock error detection flowchart
Transmit clock error detection procedures
State
Transmit
clock
wait state
Transfer state
Transfer state
Transmit clock
wait state
Noise
Transfer state has been
entered by the transmit clock
error. When SM1A is written,
IFS1 is set.
Flag set because octal
counter reaches 000.
Flag reset at
transfer completion.
SM1A
write
1
2
3
4
5
6
7
8
SCK
pin
(input)
IFS1
Figure 55 Transmit Clock Error Detection
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