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參數(shù)資料
| 型號： | HD4074654S |
| 廠商： | Hitachi,Ltd. |
| 英文描述： | 4-Bit Single-Chip Microcomputer |
| 中文描述： | 4位單片機(jī) |
| 文件頁數(shù)： | 22/109頁 |
| 文件大?。?/td> | 430K |
| 代理商： | HD4074654S |
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HD404654 Series
22
Table 8 Timer A Interrupt Mask (IMTA: $001, Bit 3)
IMTA
Interrupt Request
0
Enabled
1
Disabled (Masked)
Timer C Interrupt Request Flag (IFTC: $002, Bit 2):
Set by overflow output from timer C, as listed in
table 9.
Table 9 Timer C Interrupt Request Flag (IFTC: $002, Bit 2)
IFTC
Interrupt Request
0
No
1
Yes
Timer C Interrupt Mask (IMTC: $002, Bit 3):
Prevents (masks) an interrupt request caused by the
timer C interrupt request flag, as listed in table 10.
Table 10 Timer C Interrupt Mask (IMTC: $002, Bit 3)
IMTC
Interrupt Request
0
Enabled
1
Disabled (Masked)
Timer D Interrupt Request Flag (IFTD: $003, Bit 0):
Set by overflow output from timer D, or by the
rising or falling edge of signals input to EVND when the input capture function is used, as listed in table
11.
Table 11 Timer D Interrupt Request Flag (IFTD: $003, Bit 0)
IFTD
Interrupt Request
0
No
1
Yes
Timer D Interrupt Mask (IMTD: $003, Bit 1):
Prevents (masks) an interrupt request caused by the
timer D interrupt request flag, as listed in table 12.
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PDF描述 |
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