參數(shù)資料
型號： FIN1216MTD
廠商： FAIRCHILD SEMICONDUCTOR CORP
元件分類： 通用總線功能
英文描述： LVDS 21-Bit Serializers/De-Serializers
中文描述： TRIPLE LINE RECEIVER, PDSO48
封裝： 6.10 MM, MO-153, TSSOP-48
文件頁數(shù)： 10/17頁
文件大?。?/td> 434K
代理商： FIN1216MTD
www.fairchildsemi.com
10
F
FIGURE 1. Differential LVDS Output DC Test Circuit
Note A:
For all input pulses, t
R
or t
F
<
=
1 ns.
Note B:
C
L
includes all probe and jig capacitance.
FIGURE 2. Differential Receiver Voltage Definitions and Propagation Delay and Transition Time Test Circuit
TABLE 2. Receiver Minimum and Maximum Input Threshold Test Voltages
Applied Voltages
(V)
V
IA
1.25
1.15
2.4
2.3
0.1
0
1.5
0.9
2.4
1.8
0.6
0
Resulting Differential Input Voltage Resulting Common Mode Input Voltage
(mV)
V
ID
100
100
100
100
100
100
600
600
600
600
600
600
(V)
V
IC
1.2
1.2
2.35
2.35
0.05
0.05
1.2
1.2
2.1
2.1
0.3
0.3
V
IB
1.15
1.25
2.3
2.4
0
0.1
0.9
1.5
1.8
2.4
0
0.6
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