參數(shù)資料
型號： DS32512N
廠商： Maxim Integrated Products
文件頁數(shù)： 94/130頁
文件大小： 0K
描述： IC 12CH DS3/E3/STS1 LIU 484-BGA
產品培訓模塊： Lead (SnPb) Finish for COTS
Obsolescence Mitigation Program
標準包裝： 1
類型： 線路接口裝置（LIU）
規(guī)程： DS3
電源電壓： 3.135 V ~ 3.465 V
安裝類型： 表面貼裝
封裝/外殼： 484-BGA
供應商設備封裝： 484-BGA（23x23）
包裝： 托盤
DS32506/DS32508/DS32512
66 of 130
Register Name:
PORT.INV
Register Description:
Port I/O Invert Control Register
Register Address:
n * 80h + 0Ah
Bit #
15
14
13
12
11
10
9
8
Name
—
Default
0
Bit #
7
6
5
4
3
2
1
0
Name
—
TNEGI
TPOSI
TCLKI
—
RNEGI
RPOSI
RCLKI
Default
0
Bit 6: TNEG Invert (TNEGI).
This bit inverts the TNEG input pin when set.
0 = Noninverted
1 = Inverted
Bit 5: TPOS/TDAT Invert (TPOSI).
This bit inverts the TPOS/TDAT input pin when set.
0 = Noninverted
1 = Inverted
Bit 4: TCLK Invert (TCLKI).
This bit inverts the TCLK pin input pin when set. See Section 8.2.1.
0 = Noninverted; TPOS/TDAT and TNEG are sampled on the rising edge of TCLK.
1 = Inverted; TPOS/TDAT and TNEG are sampled on the falling edge of TCLK.
Bit 2: RNEG/RLCV Invert (RNEGI).
This bit inverts the RNEG/RLCV output pin when set.
0 = Noninverted
1 = Inverted
Bit 1: RPOS/RDAT Invert (RPOSI).
This bit inverts the RPOS/RDAT output pin when set.
0 = Noninverted
1 = Inverted
Bit 0: RCLK Invert (RCLKI).
This bit inverts the RCLKn output pin when set. See Section 8.3.6.3.
0 = Noninverted; RPOS/RDAT and RNEG/RLCV are updated on the falling edge of RCLK.
1 = Inverted; RPOS/RDAT and RNEG/RLCV are updated on the rising edge of RCLK.
相關PDF資料
PDF描述
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DS32512N# IC LIU DS3/E3/STS-1 484-BGA
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DS32512+ IC LIU DS3/E3/STS-1 484-BGA
相關代理商/技術參數(shù)
參數(shù)描述
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