參數(shù)資料
型號： DS21Q55
廠商： Maxim Integrated Products
文件頁數(shù)： 37/237頁
文件大?。?/td> 0K
描述： IC TXRX QUAD T1/E1/J1 SCT 256BGA
標準包裝： 40
功能： 收發(fā)器
接口： E1，J1，T1
電路數(shù)： 4
電源電壓： 3.14 V ~ 3.47 V
電流 - 電源： 75mA
工作溫度： 0°C ~ 70°C
安裝類型： 表面貼裝
封裝/外殼： 256-BBGA
供應商設備封裝： 256-BGA（27x27）
包裝： 托盤
包括： BERT 發(fā)生器和檢測器，雙路 HDLC 控制器
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DS21Q55 Quad T1/E1/J1 Transceiver
131 of 237
Table 21-A. HDLC Controller Registers
REGISTER
FUNCTION
CONTROL AND CONFIGURATION
H1TC, HDLC #1 Transmit Control Register
H2TC, HDLC #2 Transmit Control Register
General control over the transmit HDLC
controllers
H1RC, HDLC #1 Receive Control Register
H2RC, HDLC #2 Receive Control Register
General control over the receive HDLC
controllers
H1FC, HDLC #1 FIFO Control Register
H2FC, HDLC #2 FIFO Control Register
Sets high watermark for receiver and low
watermark for transmitter
STATUS AND INFORMATION
SR6, HDLC #1 Status Register
SR7, HDLC #2 Status Register
Key status information for both transmit and
receive directions
IMR6, HDLC #1 Interrupt Mask Register
IMR7, HDLC #2 Interrupt Mask Register
Selects which bits in the status registers (SR7
and SR8) cause interrupts
INFO4, HDLC #1 and #2 Information Register
INFO5, HDLC #1 Information Register
INFO6, HDLC #2 Information Register
Information about HDLC controller
H1RPBA, HDLC #1 Receive Packet Bytes
Available Register
H2RPBA, HDLC #2 Receive Packet Bytes
Available Register
Indicates the number of bytes that can be read
from the receive FIFO
H1TFBA, HDLC #1 Transmit FIFO Buffer
Available Register
H2TFBA, HDLC #2 Transmit FIFO Buffer
Available Register
Indicates the number of bytes that can be
written to the transmit FIFO
MAPPING
H1RCS1, H1RCS2, H1RCS3, H1RCS4, HDLC
#1 Receive Channel Select Registers
H2RCS1, H2RCS2, H2RCS3, H2RCS4, HDLC
#2 Receive Channel Select Registers
Selects which channels are mapped to the
receive HDLC controller
H1RTSBS, HDLC #1 Receive TS/Sa Bit Select
Register
H2RTSBS, HDLC #2 Receive TS/Sa Bit Select
Register
Selects which bits in a channel are used or
which Sa bits are used by the receive HDLC
controller
H1TCS1, H1TCS2, H1TCS3, H1TCS4, HDLC
#1 Transmit Channel Select Registers
H2TCS1, H2TCS2, H2TCS3, H2TCS4, HDLC
#2 Transmit Channel Select Registers
Selects which channels are mapped to the
transmit HDLC controller
H1TTSBS, HDLC # 1 Transmit TS/Sa Bit Select
Register
H2TTSBS, HDLC # 2 Transmit TS/Sa Bit Select
Register
Selects which bits in a channel are used or
which Sa bits are used by the transmit HDLC
controller
FIFOs
H1RF, HDLC #1 Receive FIFO Register
H2RF, HDLC #1 Receive FIFO Register
Access to 128-byte receive FIFO
H1TF, HDLC #1 Transmit FIFO Register
H2TF, HDLC #2 Transmit FIFO Register
Access to 128-byte transmit FIFO
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PDF描述
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參數(shù)描述
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DS21Q552BN+ 功能描述:網(wǎng)絡控制器與處理器 IC 5V Quad T1 Transceiver RoHS:否 制造商:Micrel 產(chǎn)品:Controller Area Network (CAN) 收發(fā)器數(shù)量: 數(shù)據(jù)速率: 電源電流（最大值）:595 mA 最大工作溫度:+ 85 C 安裝風格:SMD/SMT 封裝 / 箱體:PBGA-400 封裝:Tray
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