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參數(shù)資料
| 型號(hào)： | DS21Q41BT |
| 廠商： | Maxim Integrated Products |
| 文件頁(yè)數(shù)： | 11/61頁(yè) |
| 文件大?。?/td> | 0K |
| 描述： | IC FRAMER T1 QUAD 128-TQFP |
| 產(chǎn)品培訓(xùn)模塊： | Lead (SnPb) Finish for COTS Obsolescence Mitigation Program |
| 標(biāo)準(zhǔn)包裝： | 72 |
| 控制器類型： | T1 調(diào)幀器 |
| 接口： | 并行/串行 |
| 電源電壓： | 4.5 V ~ 5.5 V |
| 電流 - 電源： | 30mA |
| 工作溫度： | 0°C ~ 70°C |
| 安裝類型： | 表面貼裝 |
| 封裝/外殼： | 128-LQFP |
| 供應(yīng)商設(shè)備封裝： | 128-LQFP（14x20） |
| 包裝： | 管件 |
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DS21Q41B
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FRAMER LOOPBACK
When CCR1.0 is set to a 1, the DS21Q41B will enter a Framer LoopBack (FLB) mode. This loopback is
useful in testing and debugging applications. In FLB, the DS21Q41B will loop data from the transmit
side back to the receive side. When FLB is enabled, the following will occur:
1. An unframed all 1s code will be transmitted at TPOS and TNEG.
2. Data at RPOS and RNEG will be ignored.
3. All receive side signals will take on timing synchronous with TCLK instead of RCLK.
CCR2: COMMON CONTROL REGISTER 2 (Address=38 Hex)
(MSB)
(LSB)
TFM
TB8ZS
TSLC96
TFDL
RFM
RB8ZS
RSLC96
RFDL
SYMBOL
POSITION
NAME AND DESCRIPTION
TFM
CCR2.7
Transmit Frame Mode Select.
0=D4 framing mode
1=ESF framing mode
TB8ZS
CCR2.6
Transmit B8ZS Enable.
0=B8ZS disabled
1=B8ZS enabled
TSLC96
CCR2.5
Transmit SLC-96/Fs Bit Insertion Enable.
0=SLC-96 disabled
1=SLC-96 enabled
TFDL
CCR2.4
Transmit 0 Stuffer Enable.
0=0 stuffer disabled
1=0 stuffer enabled
RFM
CCR2.3
Receive Frame Mode Select.
0=D4 framing mode
1=ESF framing mode
RB8ZS
CCR2.2
Receive B8ZS Enable.
0=B8ZS disabled
1=B8ZS enabled
RSLC96
CCR2.1
Receive SLC-96 Enable.
0=SLC-96 disabled
1=SLC-96 enabled
RFDL
CCR2.0
Receive 0 Destuffer Enable.
0=0 destuffer disabled
1=0 destuffer enabled
相關(guān)PDF資料 |
PDF描述 |
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參數(shù)描述 |
|---|---|
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