參數(shù)資料
型號： DS21FF42N
廠商： DALLAS SEMICONDUCTOR
元件分類： Digital Transmission Controller
英文描述： DATACOM, FRAMER, PBGA300
封裝： 27 X 27 MM, BGA-300
文件頁數(shù)： 112/115頁
文件大?。?/td> 534K
代理商： DS21FF42N
DS21FF42/DS21FT42
96 of 115
RECEIVE SIDE BOUNDARY TIMING
(with elastic store disabled) Figure 24-3
RECEIVE SIDE 1.544 MHz BOUNDARY TIMING
(with elastic store enabled) Figure 24-4
RCLK
RCHCLK
RFSYNC
RCHBLK
2
Notes:
1. There is a 13 RCLK delay fromRPOS/RNEG to RSER.
2. RCHBLK is programmed to block channel 24.
3. Shown is RLINK/RLCLK in the ESF framing mode.
RLCLK
RLINK
RSER
LSB
MSB
F
MSB
CHANNEL 23
CHANNEL 24
LSB
CHANNEL 1
RSYNC
RSIG
D/B
CHANNEL 23
CHANNEL 24
D/B
CHANNEL 1
C/A
B
A
C/A
B
AA
3
RPOS
LSB
MSB
CHANNEL 1
CHANNEL 2
LSB
F
LSB MSB
RNEG
1
RSER
LSB
MSB
F
MSB
CHANNEL 23
CHANNEL 24
LSB
CHANNEL 1
RCHCLK
RCHBLK
RSYSCLK
RSYNC
2
3
Notes:
1. RSYNC is in the output mode (RCR2.3 = 0)
2. RSYNC is in the input mode (RCR2.3 = 1)
3. RCHBLK is programmed to block channel 24
RSYNC
1
RMSYNC
RSIG
D/B
CHANNEL 23
CHANNEL 24
D/B
CHANNEL 1
C/A
B
A
AB
C/A
A
相關(guān)PDF資料
PDF描述
DS21FT44N DATACOM, FRAMER, PBGA300
DS21FT44 DATACOM, FRAMER, PBGA300
DS21Q352 DATACOM, PCM TRANSCEIVER, PBGA256
DS21Q354 DATACOM, PCM TRANSCEIVER, PBGA256
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參數(shù)描述
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