layout中兩個不常用命令
實用star-sim做后仿真
關(guān)于standard cell
LVSCHK 部分參數(shù)
如何開始command file的編寫
Some Rules for Matching
將鋁線燒斷到底
Active and Passive Devices
Bond Pads
如何創(chuàng)建power MOS版圖單元
狀態(tài)機舉例
VHDL有關(guān)的書籍
Verilog中模組（module)的概念
active hdl與Foundation
硅分析（Virtuoso Silicon Analysis）
從netlist中查找subckt
ESD分析Part(1)
用calibre比較兩個Layout
DRACULA中做LVL
畫圖習慣與速度
歐位圖輔助畫圖法
Dracula 描述部分(D-F)
使用Calibre做LVL Check
Dracula 描述部分(A-C)
畫STD. CELL點線輔助法
Mapping file的使用
在PC機上運行cadence
關(guān)于 .cdsenv 的小技巧
Issues in RF IC Design: Lecture 33
高功率870nm和940nm紅外線發(fā)射器
成功模擬設(shè)計源自一頭白發(fā)
NS推出減少信號抖動的LVDS緩沖器 可提供15kV的靜電釋放保護
可實現(xiàn)更小有源箝位的高壓P溝道MOSFET
HARTING推出B+結(jié)構(gòu)壓入式AMC連接器 適用于AdvancedTCA
analog IC design
CMOS集成電路工藝 體硅CMOS工藝設(shè)計中阱工藝的選擇
集成電路核心關(guān)鍵字解釋
集成電路分類
微電子的作用
集成電路的無生產(chǎn)線設(shè)計與代工制造之間的關(guān)系
集成電路歷史回眸
雙極型器件layout一覽
EEPROM工作原理是怎樣的？
關(guān)于MOS的dummy問題
Virtuoso非正常退出時版圖的恢復
版圖設(shè)計常見問題
傳統(tǒng)AP＆R的思路
繪制inverter 掩膜版圖的一些準備工作
Antenna Effect?
建立版圖文件
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