參數(shù)資料
型號(hào)： AT89LP214-20XU
廠商： Atmel
文件頁(yè)數(shù)： 51/98頁(yè)
文件大?。?/td> 0K
描述： MCU 8051 2K FLASH 20MHZ 14-TSSOP
產(chǎn)品培訓(xùn)模塊： MCU Product Line Introduction
標(biāo)準(zhǔn)包裝： 95
系列： 89LP
核心處理器： 8051
芯體尺寸： 8-位
速度： 20MHz
連通性： SPI，UART/USART
外圍設(shè)備： 欠壓檢測(cè)/復(fù)位，POR，PWM，WDT
輸入/輸出數(shù)： 12
程序存儲(chǔ)器容量： 2KB（2K x 8）
程序存儲(chǔ)器類(lèi)型： 閃存
RAM 容量： 128 x 8
電壓 - 電源 (Vcc/Vdd)： 2.4 V ~ 5.5 V
振蕩器型： 內(nèi)部
工作溫度： -40°C ~ 85°C
封裝/外殼： 14-TSSOP（0.173"，4.40mm 寬）
包裝： 管件
55
3538E–MICRO–11/10
AT89LP213/214
The CPHA (Clock PHAse), CPOL (Clock POLarity), and SPR (Serial Peripheral clock Rate =
baud rate) bits in SPCR control the shape and rate of SCK. The two SPR bits provide four possi-
ble clock rates when the SPI is in master mode. In slave mode, the SPI will operate at the rate of
the incoming SCK as long as it does not exceed the maximum bit rate. There are also four pos-
sible combinations of SCK phase and polarity with respect to the serial data. CPHA and CPOL
determine which format is used for transmission. The SPI data transfer formats are shown in
Figures 18-4 and 18-5. To prevent glitches on SCK from disrupting the interface, CPHA, CPOL,
and SPR should not be modified while the interface is enabled, and the master device should be
enabled before the slave device(s).
Figure 18-4. SPI Transfer Format with CPHA = 0
Note:
*Not defined but normally MSB of character just received.
Figure 18-5. SPI Transfer Format with CPHA = 1
Note:
*Not defined but normally LSB of previously transmitted character.
MSB
6
5
4
3
2
1
LSB
1
2
3
4
5
6
7
8
MSB
*
65
4
3
2
1
LSB
SCK CYCLE #
(FOR REFERENCE)
SCK (CPOL = 0)
SCK (CPOL = 1)
MOSI
(FROM MASTER)
MISO
(FROM SLAVE)
SS (TO SLAVE)
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