參數(shù)資料
型號： AT89C5131A-PUTIM
廠商： Atmel
文件頁數(shù)： 18/176頁
文件大?。?/td> 0K
描述： IC 8051 MCU FLASH 32K USB 32QFN
標(biāo)準(zhǔn)包裝： 260
系列： AT89C513x
核心處理器： C52X2
芯體尺寸： 8-位
速度： 48MHz
連通性： I²C，SPI，UART/USART，USB
外圍設(shè)備： LED，POR，PWM，WDT
輸入/輸出數(shù)： 18
程序存儲器容量： 32KB（32K x 8）
程序存儲器類型： 閃存
EEPROM 大?。?/td> 4K x 8
RAM 容量： 1.25K x 8
電壓 - 電源 (Vcc/Vdd)： 2.7 V ~ 5.5 V
振蕩器型： 內(nèi)部
工作溫度： -40°C ~ 85°C
封裝/外殼： 32-VQFN 裸露焊盤
包裝： 托盤
配用： AT89STK-10-ND - KIT EVAL APPL MASS STORAGE
AT89STK-05-ND - KIT STARTER FOR AT89C5131
113
AT89C5131
4136C–USB–04/05
Registers
Table 85. SSCON Register
SSCON - Synchronous Serial Control Register (93h)
7654321
0
CR2
SSIE
STA
STO
SI
AA
CR1
CR0
Bit
Number
Bit
Mnemonic
Description
7CR2
Control Rate bit 2
See .
6SSIE
Synchronous Serial Interface Enable bit
Clear to disable SSLC.
Set to enable SSLC.
5STA
Start flag
Set to send a START condition on the bus.
4ST0
Stop flag
Set to send a STOP condition on the bus.
3SI
Synchronous Serial Interrupt flag
Set by hardware when a serial interrupt is requested.
Must be cleared by software to acknowledge interrupt.
2AA
Assert Acknowledge flag
Clear in master and slave receiver modes, to force a not acknowledge (high level
on SDA).
Clear to disable SLA or GCA recognition.
Set to recognise SLA or GCA (if GC set) for entering slave receiver or transmitter
modes.
Set in master and slave receiver modes, to force an acknowledge (low level on
SDA).
This bit has no effect when in master transmitter mode.
1CR1
Control Rate bit 1
See Table
0CR0
Control Rate bit 0
See Table
Table 86. SSDAT (095h) - Synchronous Serial Data Register (read/write)
SD7
SD6
SD5
SD4
SD3
SD2
SD1
SD0
7654321
0
Bit
Number
Bit
Mnemonic
Description
7
SD7
Address bit 7 or Data bit 7.
6
SD6
Address bit 6 or Data bit 6.
5
SD5
Address bit 5 or Data bit 5.
4
SD4
Address bit 4 or Data bit 4.
3
SD3
Address bit 3 or Data bit 3.
2
SD2
Address bit 2 or Data bit 2.
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PDF描述
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