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參數(shù)資料
| 型號： | ADV7180BSTZ |
| 廠商： | ANALOG DEVICES INC |
| 元件分類： | 顏色信號轉(zhuǎn)換 |
| 英文描述： | 10-Bit, 4 x Oversampling SDTV Video Decoder |
| 中文描述： | COLOR SIGNAL DECODER, PQFP64 |
| 封裝： | 10 X 10 MM, ROHS COMPLIANT, MS-026BCD, LQFP-64 |
| 文件頁數(shù)： | 100/112頁 |
| 文件大?。?/td> | 1320K |
| 代理商： | ADV7180BSTZ |
第1頁第2頁第3頁第4頁第5頁第6頁第7頁第8頁第9頁第10頁第11頁第12頁第13頁第14頁第15頁第16頁第17頁第18頁第19頁第20頁第21頁第22頁第23頁第24頁第25頁第26頁第27頁第28頁第29頁第30頁第31頁第32頁第33頁第34頁第35頁第36頁第37頁第38頁第39頁第40頁第41頁第42頁第43頁第44頁第45頁第46頁第47頁第48頁第49頁第50頁第51頁第52頁第53頁第54頁第55頁第56頁第57頁第58頁第59頁第60頁第61頁第62頁第63頁第64頁第65頁第66頁第67頁第68頁第69頁第70頁第71頁第72頁第73頁第74頁第75頁第76頁第77頁第78頁第79頁第80頁第81頁第82頁第83頁第84頁第85頁第86頁第87頁第88頁第89頁第90頁第91頁第92頁第93頁第94頁第95頁第96頁第97頁第98頁第99頁當前第100頁第101頁第102頁第103頁第104頁第105頁第106頁第107頁第108頁第109頁第110頁第111頁第112頁
ADV7180
Rev. A | Page 100 of 112
User Sub Map
Address Register
0x4A
Bit
(Shading Indicates
Default State)
7 6 5 4 3 2 1 0
Comments
No change in SD signal standard
detected at the output
A change in SD signal standard is
detected at the output
No change in SD vsync lock status
SD vsync lock status has changed
No change in SD hsync lock status
SD hsync lock status has changed
No change in AD_RESULT[2:0] bits in
Status Register 1
AD_RESULT[2:0] bits in Status Register 1
have changed
No change in SECAM lock status
SECAM lock status has changed
No change in PAL swinging burst
lock status
PAL swinging burst lock status has
changed
Not used
Not used
Do not clear
Clears SD_OP_CHNG_Q bit
Do not clear
Clears SD_V_LOCK_CHNG_Q bit
Do not clear
Clears SD_H_LOCK_CHNG_Q bit
Do not clear
Clears SD_AD_CHNG_Q bit
Do not clear
Clears SCM_LOCK_CHNG_Q bit
Do not clear
Clears PAL_SW_LK_CHNG_Q bit
Not used
Not used
Masks SD_OP_CHNG_Q bit
Unmasks SD_OP_CHNG_Q bit
Masks SD_V_LOCK_CHNG_Q bit
Unmasks SD_V_LOCK_CHNG_Q bit
Masks SD_H_LOCK_CHNG_Q bit
Unmasks SD_H_LOCK_CHNG_Q bit
Masks SD_AD_CHNG_Q bit
Unmasks SD_AD_CHNG_Q bit
Masks SCM_LOCK_CHNG_Q bit
Unmasks SCM_LOCK_CHNG_Q bit
Masks PAL_SW_LK_CHNG_Q bit
Unmasks PAL_SW_LK_CHNG_Q bit
Not used
Not used
Bit Description
SD_OP_CHNG_Q. SD 60 Hz/50 Hz
frame rate at output.
Notes
These bits can be cleared
and masked by Registers
0x4B and 0x4C,
respectively
0
1
0
0
1
0
1
SD_V_LOCK_CHNG_Q.
SD_H_LOCK_CHNG_Q.
SD_AD_CHNG_Q. SD autodetect
changed.
1
0
0
1
SCM_LOCK_CHNG_Q. SECAM lock.
PAL_SW_LK_CHNG_Q.
1
Reserved.
Reserved.
SD_OP_CHNG_CLR.
x
x
x
x
x
x
0
1
0
1
0
1
0
1
0
1
0
1
0
1
Interrupt Status 3
(Read Only)
SD_V_LOCK_CHNG_CLR.
0
1
SD_H_LOCK_CHNG_CLR.
0
1
SD_AD_CHNG_CLR.
0
1
SCM_LOCK_CHNG_CLR.
0
1
PAL_SW_LK_CHNG_CLR.
Reserved.
Reserved.
SD_OP_CHNG_MSK.
0
1
0x4B
Interrupt Clear 3
(Write only)
SD_V_LOCK_CHNG_ MSK.
SD_H_LOCK_CHNG_ MSK.
SD_AD_CHNG_ MSK.
SCM_LOCK_CHNG_ MSK.
PAL_SW_LK_CHNG_ MSK.
Reserved.
Reserved.
0x4C
Interrupt Mask 3
(Read/Write)
相關PDF資料 |
PDF描述 |
|---|---|
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| ADV7181BCP | Multiformat SDTV Video Decoder |
相關代理商/技術參數(shù) |
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