參數(shù)資料
型號： ADSP-2181KS-115
廠商： ANALOG DEVICES INC
元件分類： 數(shù)字信號處理
英文描述： DSP Microcomputer
中文描述： 24-BIT, 14.4 MHz, OTHER DSP, PQFP128
封裝： PLASTIC, QFP-128
文件頁數(shù)： 14/32頁
文件大?。?/td> 290K
代理商： ADSP-2181KS-115
REV. D
ADSP-2181
–14–
Parameter
Min
Max
Unit
Clock Signals and Reset
Timing Requirements
:
t
CK I
t
CK IL
t
CK IH
CLK IN Period
CLK IN Width Low
CLK IN Width High
50
20
20
150
ns
ns
ns
Switching Characteristics
:
t
CK L
t
CK H
t
CK OH
CLK OUT Width Low
CLK OUT Width High
CLK IN High to CLK OUT High
0.5t
CK
– 7
0.5t
CK
– 7
0
ns
ns
ns
20
Control Signals
Timing Requirement
:
t
RSP
RESET
Width Low
5t
CK
1
ns
NOT E
1
Applies after power-up sequence is complete. Internal phase lock loop requires no more than 2000 CLK IN cycles assuming stable CLK IN (not including crystal
oscillator start-up time).
t
CKOH
t
CKH
t
CKI
t
CKIH
t
CKIL
t
CKL
t
MH
t
MS
CLKIN
CLKOUT
PF(2:0)
*
RESET
*
PF2 IS MODE C, PF1 IS MODE B, PF0 IS MODE A
Figure 8. Clock Signals
相關(guān)PDF資料
PDF描述
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參數(shù)描述
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