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參數資料
型號： ADN2812ACPZ-RL
廠商： Analog Devices Inc
文件頁數： 22/28頁
文件大?。?/td> 0K
描述： IC CLOCK/DATA RECOVERY 32LFCSP
標準包裝： 5,000
類型： 時鐘和數據恢復（CDR），多路復用器
PLL： 是
主要目的： SONET/SDH
輸入： CML
輸出： CML
電路數： 1
比率 - 輸入:輸出： 1:2
差分 - 輸入:輸出： 是/是
頻率 - 最大： 2.7GHz
電源電壓： 3 V ~ 3.6 V
工作溫度： -40°C ~ 85°C
安裝類型： 表面貼裝
封裝/外殼： 32-VFQFN 裸露焊盤，CSP
供應商設備封裝： 32-LFCSP-VQ（5x5）
包裝： 帶卷 (TR)
Data Sheet
ADN2812
Rev. E | Page 3 of 28
SPECIFICATIONS
TA = TMIN to TMAX, VCC = VMIN to VMAX, VEE = 0 V, CF = 0.47 F, SLICEP = SLICEN = VEE, input data pattern: PRBS 223 1,
unless otherwise noted.
Table 1.
Parameter
Conditions
Min
Typ
Max
Unit
QUANTIZER—DC CHARACTERISTICS
Input Voltage Range
@ PIN or NIN, dc-coupled
1.8
2.8
V
Peak-to-Peak Differential Input
PIN – NIN
2.0
V
Input Common-Mode Level
2.3
2.5
2.8
V
Differential Input Sensitivity
223 1 PRBS, ac-coupled,1 BER = 1 × 10–10
10
6
mV p-p
Input Overdrive
5
3
mV p-p
Input Offset
500
V
Input RMS Noise
BER = 1 x 10–10
290
V rms
QUANTIZER—AC CHARACTERISTICS
Data Rate
12.3
2700
Mb/s
S11
@ 2.5 GHz
15
dB
Input Resistance
Differential
100
Input Capacitance
0.65
pF
QUANTIZER—SLICE ADJUSTMENT
Gain
SLICEP – SLICEN = ±0.5 V
0.08
0.1
0.125
V/V
Differential Control Voltage Input
SLICEP – SLICEN
0.95
+0.95
V
Control Voltage Range
DC level @ SLICEP or SLICEN
VEE
0.95
V
Slice Threshold Offset
1
mV
LOSS OF SIGNAL DETECT (LOS)
Loss of Signal Detect Range
RThresh = 0 (see Figure 5)
11
13
17
mV
RThresh = 100 k
1.5
3
4.0
mV
Hysteresis (Electrical)
OC-48
RThresh = 0
5.6
6
7.2
dB
RThresh = 100 k
3.7
6
8.4
dB
OC-1
RThresh = 0
5.6
6
7.2
dB
RThresh = 10 k
2.0
4
6.7
dB
LOS Assert Time
DC-coupled2
500
ns
LOS Deassert Time
DC-coupled2
450
ns
LOSS OF LOCK DETECT (LOL)
VCO Frequency Error for LOL Assert
With respect to nominal
1000
ppm
VCO Frequency Error for LOL Deassert
With respect to nominal
250
ppm
LOL Response Time
12.3 Mb/s
4
ms
OC-12
1.0
s
OC-48
1.0
s
ACQUISITION TIME
Lock to Data Mode
OC-48
1.3
ms
OC-12
2.0
ms
OC-3
3.4
ms
OC-1
9.8
ms
12.3 Mb/s
40.0
ms
Optional Lock to REFCLK Mode
10.0
ms
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