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參數(shù)資料
| 型號： | ADG729 |
| 廠商： | Analog Devices, Inc. |
| 英文描述： | CMOS , Low Voltage, 2 Wire, Serially Controlled Matrix Switches(CMOS,低電壓,二線,串行控制四通道矩陣開關(guān)) |
| 中文描述： | 的CMOS，低電壓，2線，串行控制矩陣開關(guān)（的CMOS，低電壓，二線，串行控制四通道矩陣開關(guān)） |
| 文件頁數(shù)： | 8/10頁 |
| 文件大?。?/td> | 139K |
| 代理商： | ADG729 |
–8–
REV. PrC
Prelimnary Technical Data
PRELMNARY
DATA
TECHNCAL
ADG728/ADG729
WR IT E OP E R A T ION
When writing to the ADG728/ADG729, the user must
begin with an address byte and R/
W
bit, after which the
switch will Acknowledge that it is prepared to receive data
by pulling SDA low. T his address byte is followed by the
8-bit word. T he write operations for each matrix switch
are shown in the figures below.
Figure 3. ADG728 Write Sequence
R E A D OPE R A T ION
When reading data back from the ADG728/ADG729, the
user must begin with an address byte and R/
W
bit, after
which the matrix switch will Acknowledge that it is pre-
pared to transmit data by pulling SDA low. T he readback
operation is a single byte which consists of the 8 data bits
in the input register. T he read operations for each part are
shown in the figures below.
Figure 5. ADG728 Readback Sequence
SCL
SDA
S8
S7
S6
S5
S4
S3
S2
S1
0
0
1
1
A0
R/W
STOP
COND
BY
MASTER
ACK
BY
ADG728
START
COND
BY
MASTER
ADDRESS BYTE
DATA BYTE
ACK
BY
ADG728
A1
1
SCL
SDA
S8
S7
S6
S5
S4
S3
S2
S1
0
0
0
1
A0
R/W
STOP
COND
BY
MASTER
ACK
BY
ADG729
START
COND
BY
MASTER
ADDRESS BYTE
DATA BYTE
ACK
BY
ADG729
A1
1
Figure 4. ADG729 Write Sequence
SCL
SDA
S8
S7
S6
S5
S4
S3
S2
S1
1
0
0
1
1
A0
R/W
STOP
COND
BY
MASTER
ACK
BY
ADG728
START
COND
BY
MASTER
ADDRESS BYTE
DATA BYTE
NO ACK
BY
MASTER
A1
SCL
SDA
S8
S7
S6
S5
S4
S3
S2
S1
0
0
0
1
A0
R/W
STOP
COND
BY
MASTER
ACK
BY
ADG729
START
COND
BY
MASTER
ADDRESS BYTE
DATA BYTE
NO ACK
BY
MASTER
A1
1
Figure 6. ADG729 Readback Sequence
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PDF描述 |
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