XO ENABLED (REFOUT = RE" />
參數(shù)資料
型號： ADF4252BCPZ-R7
廠商： Analog Devices Inc
文件頁數(shù)： 9/28頁
文件大?。?/td> 0K
描述： IC PLL FREQ SYNTHESIZER 24LFCSP
標(biāo)準(zhǔn)包裝： 1,500
類型： 時鐘/頻率合成器（RF/IF），分?jǐn)?shù)-N，整數(shù)-N，
PLL： 是
輸入： CMOS，TTL
輸出： 時鐘
電路數(shù)： 1
比率 - 輸入:輸出： 3:2
差分 - 輸入:輸出： 是/無
頻率 - 最大： 3GHz
除法器/乘法器： 是/無
電源電壓： 2.7 V ~ 3.3 V
工作溫度： -40°C ~ 85°C
安裝類型： 表面貼裝
封裝/外殼： 24-VFQFN 裸露焊盤，CSP
供應(yīng)商設(shè)備封裝： 24-LFCSP-VQ（4x4）
包裝： 帶卷 (TR)
配用： EVAL-ADF4252EBZ2-ND - BOARD EVAL ADF4252 NO VCO/FILTER
REV. B
ADF4252
–17–
Table VI. Master Register Map
P11
0
1
P12
0
XO ENABLED (REFOUT = REFIN)
1
XO DISABLED (REFOUT = LOGIC LOW)
(REFOUT = LOGIC HIGH WHEN IN POWER-DOWN)
P10
0
1
P9
0
1
0
LOGIC LOW
0
1
IF ANALOG LOCK DETECT
0
1
0
IF R DIVIDER OUTPUT
0
1
IF N DIVIDER OUTPUT
0
1
0
RF ANALOG LOCK DETECT
0
1
0
1
RF/IF ANALOG LOCK DETECT
0
1
0
IF DIGITAL LOCK DETECT
0
1
LOGIC HIGH
1
0
RF R DIVIDER OUTPUT
1
0
1
RF N DIVIDER OUTPUT
1
0
1
0
THREE-STATE OUTPUT
1
0
1
LOGIC LOW
1
0
RF DIGITAL LOCK DETECT
1
0
1
RF/IF DIGITAL LOCK DETECT
1
0
LOGIC HIGH
1
LOGIC LOW
DB10
DB9
DB8
DB7
DB6
DB5
DB4
DB3
DB2
DB1
DB0
C2 (1)
C1 (1)
P9
P10
P11
P12
M1
M2
M3
M4
CONTROL
BITS
MUXOUT
C3 (0)
XO
DI
S
ABLE
P
OWER-
D
OWN
CP
THREE-
ST
A
T
E
C
OUNTER
R
ESET
MUXOUT
M1
M2
M3
M4
COUNTER RESET
DISABLED
ENABLED
CP THREE-STATE
DISABLED
THREE-STATE
POWER-DOWN
DISABLED
ENABLED
XO DISABLE
相關(guān)PDF資料
PDF描述
ADF4350BCPZ-RL IC SYNTH PLL VCO FN/IN 32LFCSP
ADF4351BCPZ IC SYNTH PLL VCO 32LFCSP
ADF4360-0BCPZRL7 IC SYNTHESIZER VCO 24LFCSP
ADF4360-1BCPZRL7 IC SYNTHESIZER VCO 24LFCSP
ADF4360-2BCPZRL7 IC SYNTHESIZER VCO 24LFCSP
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參數(shù)描述
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ADF4350ABCPZ 制造商:Analog Devices 功能描述:F-N WITH HIGH PERFORMANCE INTEGRATED VCO - Trays
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