參數(shù)資料
型號： AD9551BCPZ
廠商： Analog Devices Inc
文件頁數(shù)： 6/40頁
文件大?。?/td> 0K
描述： IC CLOCK GEN MULTISERV 40-LFCSP
標準包裝： 1
類型： 時鐘發(fā)生器
PLL： 是
輸入： 晶體
輸出： CMOS，LVDS，LVPECL
電路數(shù)： 1
比率 - 輸入:輸出： 2:2
差分 - 輸入:輸出： 是/是
頻率 - 最大： 900MHz
除法器/乘法器： 無/無
電源電壓： 3.3V
工作溫度： -40°C ~ 85°C
安裝類型： 表面貼裝
封裝/外殼： 40-VFQFN 裸露焊盤，CSP
供應商設(shè)備封裝： 40-LFCSP-VQ（6x6）
包裝： 托盤
AD9551
Rev. B | Page 14 of 40
PRESET FREQUENCY RATIOS
The frequency selection pins (A[3:0], B[3:0], and Y[3:0]) allow
the user to hardwire the device for preset input and output divider
values based on the pin logic states. The A[3:0] pins control the
REFA dividers, the B[3:0] pins control the REFB dividers, and
the Y[3:0] pins control the feedback and output dividers. The
pins decode ground or open connections as Logic 0 or Logic 1,
respectively. To override the preset divider settings, use the serial
I/O port to program the desired divider values.
A[3:0], B[3:0]. The logic state of the A[3:0] or B[3:0] pins.
NA, NB. The integer part of the REFA input divider (NA) or
the REFB input divider (NB).
MODA, MODB. The modulus of the REFA input divider
SDM (MODA) or the REFB input divider SDM (MODB).
FRACA, FRACB. The fractional part of the REFA input
divider SDM (FRACA) or the REFB input divider SDM
(FRACB).
fREFA, fREFB. The frequency of the REFA input (fREFA) or the
REFB input (fREFB).
The divider settings shown in Table 13 cause the frequency at the
reference input of the output PLL’s PFD (fIF) to operate at exactly
26 MHz when using the indicated input reference frequency,
fREFA or fREFB, assuming the use of a 26 MHz external crystal.
Table 13. Preset Input Settings
A[3:0], B[3:0]
NA, NB
MODA, MODB
FRACA, FRACB
fREFA, fREFB (MHz)1
0000
23
130,000
110,800
622.08
0001
24
130,000
120,000
625
0010
24
154,050
114,594
( )
33
.
627
08
.
622
237
239
≈
0011
24
130,000
45,200
()
52
.
641
08
.
622
64
66
≡
0100
24
166,400
96,400
()
53125
.
644
625
64
66
≡
0101
25
104,000
44,625
421875
.
657
16
75
.
10518
≡
0110
25
198,016
42,891
()
18
.
660
238
239
16
75
.
10518
≈
0111
25
154,700
41,820
()
51
.
666
08
.
622
238
255
≈
1000
25
154,050
74,970
()
33
.
669
08
.
622
237
255
≈
1001
25
182,000
93,000
()
64
.
669
625
14
15
≈
1010
25
153,400
108,120
()
255
16
.
672
08
.
622
236
≈
1011
26
197,184
67,998
() ( )
48
66
255
.
693
625
64
237
≈
×
1100
26
146,900
83,612
()
253
40
.
696
08
.
622
226 ≈
1101
27
198,016
161,755
()
255
75
.
10518
38
.
704
238
16
≈
1110
27
197,184
115,995
()
255
75
.
10518
35
.
707
237
16
≈
19.44 MHz mode
1 Assumes the use of a 26 MHz external crystal.
2 If all four A[3:0] pins or all four B[3:0] pins are Logic 1, the 19.44 MHz mode is in effect.
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PDF描述
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AD9552 制造商:AD 制造商全稱:Analog Devices 功能描述:Oscillator Frequency Upconverter
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AD9552BCPZ 功能描述:IC PLL CLOCK GEN LP 32LFCSP RoHS:是 類別:集成電路 (IC) >> 時鐘/計時 - 時鐘發(fā)生器，PLL，頻率合成器 系列:- 標準包裝:2,000 系列:- 類型:PLL 頻率合成器 PLL:是 輸入:晶體 輸出:時鐘 電路數(shù):1 比率 - 輸入:輸出:1:1 差分 - 輸入:輸出:無/無 頻率 - 最大:1GHz 除法器/乘法器:是/無 電源電壓:4.5 V ~ 5.5 V 工作溫度:-20°C ~ 85°C 安裝類型:表面貼裝 封裝/外殼:16-LSSOP（0.175"，4.40mm 寬） 供應商設(shè)備封裝:16-SSOP 包裝:帶卷 (TR) 其它名稱:NJW1504V-TE1-NDNJW1504V-TE1TR
AD9552BCPZ 制造商:Analog Devices 功能描述:IC PLL CLOCK GENERATOR 112.5MHZ LFCSP-32
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