參數(shù)資料
型號(hào)： AD9524/PCBZ
廠商： Analog Devices Inc
文件頁數(shù)： 43/56頁
文件大?。?/td> 0K
描述： BOARD EVAL FOR AD9524
設(shè)計(jì)資源： AD9524 Schematic
AD9524 BOM
AD9524 Gerber Files
標(biāo)準(zhǔn)包裝： 1
主要目的： 計(jì)時(shí)，時(shí)鐘發(fā)生器
嵌入式： 否
已用 IC / 零件： AD9524
主要屬性： USB 供電或外部電源
次要屬性： 狀態(tài) LED
已供物品： 板
配用： AD9524BCPZ-ND - IC INTEGER-N CLCK GEN 48LFCSP
AD9524
Data Sheet
Rev. E | Page 48 of 56
Table 48. VCO Control
Address
Bits
Bit Name
Description
0x0F3
[7:5]
Reserved
Reserved.
4
Force release of distribution sync
when PLL2 is unlocked
0 (default): distribution is held in sync (static) until the output PLL locks. Then it is
automatically released from sync with all dividers synchronized.
1: overrides the PLL2 lock detector state; forces release of the distribution from
sync.
3
Reserved
0 (default): value must remain 0.
2
Force VCO to midpoint frequency
Selects VCO control voltage functionality.
0 (default): normal VCO operation.
1: forces VCO control voltage to midscale.
1
Calibrate VCO (not autoclearing)
1: initiates VCO calibration (this is not an autoclearing bit).
0: resets the VCO calibration.
0
Reserved
Reserved.
Table 49. VCO Divider Control
Address
Bits
Bit Name
Description
0x0F4
[7:4]
Reserved
Reserved.
3
VCO divider power-down
1: powers down the divider.
0: normal operation.
[2:0]
VCO divider
Note that the VCO divider connects to all output channels.
Bit 2
Bit 1
Bit 0
Divider Value
0
Divide-by-4
0
1
Divide-by-5
0
1
0
Divide-by-6
0
1
Divide-by-7
1
0
Divide-by-8
1
0
1
Divide-by-9
1
0
Divide-by-10
1
Divide-by-11
相關(guān)PDF資料
PDF描述
V150C12E150BF CONVERTER MOD DC/DC 12V 150W
0982660986 CBL 27PS 0.5MM JMPR TYPE D 1.18"
H6MMH-3006G DIP CABLE - HDM30H/AE30G/HDM30H
TCMD-25-T-02.00-01-N CABLE ASSEM 2MM 50POS M-F 2"
GEC17DRXI-S734 CONN EDGECARD 34POS DIP .100 SLD
相關(guān)代理商/技術(shù)參數(shù)
參數(shù)描述
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