參數(shù)資料
型號： AD9520-5BCPZ
廠商： Analog Devices Inc
文件頁數(shù)： 9/76頁
文件大?。?/td> 0K
描述： IC CLOCK GEN EXT VCO 64-LFCSP
設(shè)計資源： Synchronizing Multiple AD9910 1 GSPS Direct Digital Synthesizers (CN0121)
Phase Coherent FSK Modulator (CN0186)
標準包裝： 1
類型： 時鐘發(fā)生器，扇出配送
PLL： 是
輸入： CMOS，LVDS，LVPECL
輸出： CMOS，LVPECL
電路數(shù)： 1
比率 - 輸入:輸出： 2:12，2:24
差分 - 輸入:輸出： 是/是
頻率 - 最大： 2.4GHz
除法器/乘法器： 是/無
電源電壓： 3.135 V ~ 3.465 V
工作溫度： -40°C ~ 85°C
安裝類型： 表面貼裝
封裝/外殼： 64-VFQFN 裸露焊盤，CSP
供應(yīng)商設(shè)備封裝： 64-LFCSP-VQ（9x9）
包裝： 托盤
產(chǎn)品目錄頁面： 776 (CN2011-ZH PDF)
Data Sheet
AD9520-5
Rev. A | Page 17 of 76
PIN CONFIGURATION AND FUNCTION DESCRIPTIONS
Figure 5. Pin Configuration
Table 18. Pin Function Descriptions
Pin No.
Input/
Output
Pin Type
Mnemonic
Description
1, 11, 12, 32,
40, 41, 49,
57, 60, 61
I
Power
VS
3.3 V Power Pins.
2
O
3.3 V CMOS
REFMON
Reference Monitor (Output). This pin has multiple selectable outputs.
3
O
3.3 V CMOS
LD
Lock Detect (Output). This pin has multiple selectable outputs.
4
I
Power
VCP
Power Supply for Charge Pump (CP); VS ≤ VCP ≤5.25 V. VCP must still be connected to
3.3 V if the PLL is not used.
5
O
Loop filter
CP
Charge Pump (Output). This pin connects to an external loop filter; it can be left
unconnected if the PLL is not used.
6
O
3.3 V CMOS
STATUS
Programmable Status Output.
7
I
3.3 V CMOS
REF_SEL
Reference Select. This pin selects REF1 (low) or REF2 (high) and has an internal 30 kΩ
pull-down resistor.
8
I
3.3 V CMOS
SYNC
Manual Synchronization and Manual Holdover. This pin initiates a manual
synchronization and is used for manual holdover. Active low. This pin has an
internal 30 kΩ pull-up resistor.
9, 10
NC
No Connect. Do not connect to these pins. These pins can be left floating.
13
I
Differential
clock input
CLK
Along with CLK, this pin is the differential input for the clock distribution section.
14
I
Differential
clock input
CLK
Along with CLK, this pin is the differential input for the clock distribution section. If a
single-ended input is connected to the CLK pin, connect a 0.1 F bypass capacitor
from this pin to ground.
NOTES
1. NC = NO CONNECT. DO NOT CONNECT TO THIS PIN.
2. EXPOSED DIE PAD MUST BE CONNECTED TO GND.
PIN 1
INDICATOR
17
18
19
20
21
22
23
24
25
26
27
28
29
30
31
32
S
D
IO/S
D
A
S
DO
G
ND
SP1
SP0
EEPR
O
M
R
ESET
PD
O
UT
9
(
O
UT
9A)
O
UT
9
(
O
UT
9B)
V
S
_DRV
O
UT
10
(
O
UT
10A)
O
UT
10
(
O
UT
10B)
O
UT
11
(
O
UT
11A)
O
UT
11
(
O
UT
11B)
VS
64
63
62
61
60
59
58
57
56
55
54
53
52
51
50
49
RE
F
IN
(
RE
F
1)
RE
F
IN
(
RE
F
2)
C
PR
SET
VS
G
ND
R
SET
VS
O
UT
0
(
O
UT
0A)
O
UT
0
(
O
UT
0B)
V
S
_DRV
O
UT
1
(
O
UT
1A)
O
UT
1
(
O
UT
1B)
O
UT
2
(
O
UT
2A)
O
UT
2
(
O
UT
2B)
VS
1
2
3
4
5
6
7
8
9
10
11
12
13
14
15
16
VS
REFMON
LD
VCP
CP
STATUS
REF_SEL
SYNC
NC
VS
CLK
CS
SCLK/SCL
OUT3 (OUT3A)
OUT3 (OUT3B)
VS_DRV
OUT4 (OUT4A)
OUT4 (OUT4B)
OUT5 (OUT5A)
OUT5 (OUT5B)
VS
OUT8 (OUT8B)
OUT8 (OUT8A)
OUT7 (OUT7B)
OUT7 (OUT7A)
VS_DRV
OUT6 (OUT6B)
OUT6 (OUT6A)
48
47
46
45
44
43
42
41
40
39
38
37
36
35
34
33
AD9520-5
TOP VIEW
(Not to Scale)
07239-
003
相關(guān)PDF資料
PDF描述
M83723/83G1203N CONN RCPT 3POS WALL MT W/PINS
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參數(shù)描述
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AD9521JH 制造商:未知廠家 制造商全稱:未知廠家 功能描述:Log/Antilog Amplifier
AD9521KH 制造商:未知廠家 制造商全稱:未知廠家 功能描述:Log/Antilog Amplifier
AD9521SE 制造商:未知廠家 制造商全稱:未知廠家 功能描述:Log/Antilog Amplifier
AD9521SH 制造商:未知廠家 制造商全稱:未知廠家 功能描述:Log/Antilog Amplifier
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