參數(shù)資料
型號： AD5317
廠商： Analog Devices, Inc.
英文描述： Dual Rail-To-Rail,Voltage Output 10-Bit DACs(滿幅度電壓輸出雙10位D/A轉換器)
中文描述： 雙通道軌至軌電壓輸出10位DAC（滿幅度電壓輸出雙10位的D / A轉換器）
文件頁數(shù)： 3/8頁
文件大?。?/td> 336K
代理商： AD5317
2
3
AD5307/17 Prelim Technical Information
Prelim A1 4/98
PRELMNARY
Parameter
3
B Version
1
Min
Units
Conditions/Comments
Typ
Max
Output Voltage Settling Time
AD5307
AD5317
Slew Rate
Digital to Analog Glitch Impulse
Digital Feedthrough
Digital Crosstalk
Analog Crosstalk
DAC-to-DAC Crosstalk
Multiplying Bandwidth
Total Harmonic Distortion
Power Supply Rejection Ratio
Output Noise Spectral Density
4
6
1
20
0.5
0.5
10
15
TBD
TBD
μs
μs
V/μs
nV-s
nV-s
nV-s
nV-s
nV-s
kHz
dB
%/%
nV/(Hz)
1/2
Full-Scale settling time. Vref = +2.5V. Vdd = +5V.
Full-Scale settling time. Vref = +2.5V. Vdd = +5V.
1 LSB change around major carry.
TBD
V
DD
= ±10%
TBD
TIMING CHARACTERISTICS
1, 2
(V
DD
= +2.5 V to +5.5 V; GND= 0 V; All specifications T
MIN
to T
MAX
unless other-
wise noted)
Limit at T
MIN
, T
MAX
(B Version)
Parameter
Units
Conditions/Comments
t
1
t
2
t
3
t
4
t
5
t
6
t
7
t
8
t
9
t
t
10
t
123,4
t
134
t
144
33
13
13
0
5
4.5
0
33
20
20
5
20
5
10
ns min
ns min
ns min
ns min
ns min
ns min
ns min
ns min
ns min
ns min
ns min
ns max
ns min
ns min
SCLK Cycle Time
SCLK
High Time
SCLK
Low Time
SYNC
to SCLK Active Edge Setup Time
Data Setup Time
Data Hold Time
SCLK Falling Edge to
SYNC
Rising Edge
Minimum
SYNC
High Time
LDAC
Pulse Width
CLR
Pulse Width
SCLK Falling edge to SDO Invalid
SCLK Falling edge to SDO Valid
SCLK Falling Edge to
SYNC
Rising Edge
SYNC
Rising Edge to SCLK Rising Edge
NOTES
1
Sample tested at +25°C to ensure compliance. All input signals are specified with tr = tf = 5 ns (10% to 90% of V
DD
) and timed from a voltage level of (V
IL
+ V
IH
)/2.
2
See Figures 1 and 2.
3
These are measured with the load circuit of Figure x.
4
Daisy-Chain Mode only
AC CHARACTERISTICS
(V
DD
= +2.5V to +5.5 V; R
L
=2k
to GND; C
L
=500pFto GND; All
specifications T
MIN
to T
MAX
unless otherwise noted.)
NOTES
See Terminology
1
Temperature ranges are as follows: B Version: -40°C to +105°C.
2
Linearity is tested using a reduced code range.
3
Guaranteed by Design and Characterization, not production tested.
Specifications subject to change without notice.
+1.6V
IOL
2mA
2m A
IOH
TO
OUTPUT
PIN
CL
50pF
Figure x. Load Circuit for Digital Output (SDO)Timing Specifications
相關PDF資料
PDF描述
AD5320(中文) Rail-to-Rail Voltage Output 12-Bit DAC(滿幅度電壓輸出12位D/A轉換器)
AD5346 Dual 12-bit 80MSPS ADC with serialized LVDS output 48-VQFN -40 to 85
AD5346BCP Dual 12-bit 80MSPS ADC with serialized LVDS output 48-VQFN -40 to 85
AD5346BCP-REEL7 Dual 12-bit 105MSPS ADC with serialized LVDS output 48-VQFN -40 to 85
AD5346BRU Dual 12-bit 105MSPS ADC with serialized LVDS output 48-VQFN -40 to 85
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參數(shù)描述
AD5317ARU 功能描述:IC DAC 10BIT QUAD W/BUFF 16TSSOP RoHS:否 類別:集成電路 (IC) >> 數(shù)據(jù)采集 - 數(shù)模轉換器 系列:- 標準包裝:2,400 系列:- 設置時間:- 位數(shù):18 數(shù)據(jù)接口:串行 轉換器數(shù)目:3 電壓電源:模擬和數(shù)字 功率耗散（最大）:- 工作溫度:-40°C ~ 85°C 安裝類型:表面貼裝 封裝/外殼:36-TFBGA 供應商設備封裝:36-TFBGA 包裝:帶卷 (TR) 輸出數(shù)目和類型:* 采樣率（每秒）:*
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AD5317BRU 功能描述:IC DAC 10BIT QUAD W/BUFF 16TSSOP RoHS:否 類別:集成電路 (IC) >> 數(shù)據(jù)采集 - 數(shù)模轉換器 系列:- 標準包裝:47 系列:- 設置時間:2µs 位數(shù):14 數(shù)據(jù)接口:并聯(lián) 轉換器數(shù)目:1 電壓電源:單電源 功率耗散（最大）:55µW 工作溫度:-40°C ~ 85°C 安裝類型:表面貼裝 封裝/外殼:28-SSOP（0.209"，5.30mm 寬） 供應商設備封裝:28-SSOP 包裝:管件 輸出數(shù)目和類型:1 電流，單極；1 電流，雙極 采樣率（每秒）:*
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