參數(shù)資料
型號： 74LCX652
廠商： 意法半導(dǎo)體
英文描述： Low Voltage CMOS Octal Bus Transceiver/Register with 5V Tolerant Inputs and Outputs(低壓八總線收發(fā)器/寄存器)
中文描述： 低電壓的CMOS八路總線收發(fā)器/有5V容限輸入和輸出寄存器（低壓八總線收發(fā)器/寄存器）
文件頁數(shù)： 7/13頁
文件大?。?/td> 120K
代理商： 74LCX652
CAPACITIVE CHARACTERISTICS
Symbol
Parameter
Test Conditions
Value
T
A
= 25
o
C
Min.
Typ.
Unit
V
CC
(V)
Max.
C
IN
C
i/o
C
PD
Input Capacitance
I/O Capacitance
Power Dissipation Capacitance (note 1)
3.3
3.3
3.3
V
IN
= 0 to V
CC
V
IN
= 0 to V
CC
f
IN
= 10MHz
V
IN
= 0 or V
CC
6
pF
pF
pF
10
TBD
1) C
PD
isdefined as the value ofthe IC’s internalequivalent capacitance which iscalculated fromtheoperating currentconsumption without load. Average
operting current can beobtained bythe followingequation. I
CC
(opr) = C
PD
V
CC
f
IN
+I
CC
/n(per circuit)
AC ELECTRICAL CHARACTERISTICS
(C
L
= 50 pF, R
L
= 500
, Input t
r
= t
f
= 2.5 ns)
Symbol
Parameter
Test Condition
Value
Unit
V
CC
(V)
Waveform
-40 to 85
o
C
Min.
1.5
1.5
1.5
1.5
1.5
1.5
1.5
1.5
1.5
1.5
2.5
2.5
1.5
1.5
4.0
3.3
150
Max.
9.5
8.5
8.0
7.0
9.5
8.5
9.5
8.5
9.5
8.5
t
PLH
t
PHL
Propagation Delay Time
CK to Q or Q
2.7
1
ns
3.0 to 3.6
2.7
3.0 to 3.6
2.7
3.0 to 3.6
2.7
3.0 to 3.6
2.7
3.0 to 3.6
2.7
3.0 to 3.6
2.7
3.0 to 3.6
2.7
3.0 to 3.6
3.0 to 3.6
3.0 to 3.6
t
PLH
t
PHL
Propagation Delay Time
An or Bn to Q or Q
1
ns
t
PLH
t
PHL
Propagation Delay Time
SELECT to Q or Q
1
ns
t
PZL
t
PZH
Output Enable Time
2
ns
t
PLZ
t
PHZ
Output Disable Time
2
ns
t
s
Setup Time, HIGh or LOW Level Data
to Ck
1
ns
t
h
Hold Time, HIGh or LOW Level Data to
Ck
1
ns
t
w
CK Pulse Width, HIGH or LOW
3
ns
f
MAX
t
OSLZ
t
OSHL
Clock Pulse Frequency
Output to Output Skew Time (note 1, 2)
1
MHz
ns
1.0
1) Skew isdefined as the absolute value of the difference between theactual propagation delay forany twooutputs ofthe samedevice switching in the
same direction, either HIGHor LOW (t
OSLH
=|t
PLHm
-t
PLHn
|,t
OSHL
=|t
PHLm
-t
pHLn
|)
2) Parameter guaranteed bydesign
74LCX652
7/13
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PDF描述
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