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參數(shù)資料
| 型號： | 74LCX646 |
| 廠商： | 意法半導(dǎo)體 |
| 英文描述： | Low Voltage CMOS Octal Bus Transceiver/Register with 5V Tolerant Inputs and Outputs(低壓八總線收發(fā)器/寄存器) |
| 中文描述： | 低電壓的CMOS八路總線收發(fā)器/有5V容限輸入和輸出寄存器（低壓八總線收發(fā)器/寄存器） |
| 文件頁數(shù)： | 2/13頁 |
| 文件大小： | 120K |
| 代理商： | 74LCX646 |
will receive datawhen enable G is active (low).
In the isolation mode (enable G high), ”A” data
may be stored in one register and/or ”B” data
may be stored in the other register. When an
output bus is disabled, the input bus is still
enabled and may be used to store and transmit
data. Only one of the two buses, A or B, may be
driven at a time.
It has same speed performance at 3.3V than 5V,
AC/ACT family, combined with a lower power
consumption.
All
inputs
and
outputs
protection circuits against static discharge, giving
them 2KV ESD immunity and transient excess
voltage.
are
equipped with
INPUT AND OUTPUT EQUIVALENTCIRCUIT
PINDESCRIPTION
PIN No
1
2
3
SYMBOL
CAB
SAB
GAB
A1 to A8
B1 to B8
G
SBA
CBA
GND
V
CC
NAME AND FUNCTION
A to B Clock Input (LOW to HIGH, Edge-Trigged)
Select A to B Source Input
Direction Control Input
A Data Inputs/Outputs
B Data Inputs/Outputs
Output Enable Input (Active LOW)
Select B to A Source Input
B to A Clock Input (LOW to HIGH, Edge-Triggered)
Ground (0V)
Positive Supply Voltage
4, 5, 6, 7, 8, 9, 10, 11
20, 19, 18, 17, 16, 15,14, 13
21
22
23
12
24
74LCX646
2/13
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PDF描述 |
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參數(shù)描述 |
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