參數(shù)資料
型號： 72V285L15TFI9
廠商： INTEGRATED DEVICE TECHNOLOGY INC
元件分類： FIFO
英文描述： 64K X 18 OTHER FIFO, 10 ns, PQFP64
封裝： STQFP-64
文件頁數(shù)： 11/25頁
文件大?。?/td> 266K
代理商： 72V285L15TFI9
19
COMMERCIAL AND INDUSTRIAL
TEMPERATURERANGES
IDT72V275/72V285 3.3V CMOS SUPERSYNC FIFOTM
32,768 x 18 and 65,536 x 18
NOTES:
1. Retransmit setup is complete after
EF returns HIGH, only then can a read operation begin.
2.
OE = LOW.
3. W1 = first word written to the FIFO after Master Reset, W2 = second word written to the FIFO after Master Reset.
4. No more than D - 2 may be written to the FIFO between Reset (Master or Partial) and Retransmit setup. Therefore,
FF will be HIGH throughout the Retransmit setup procedure. D = 32,768
for IDT72V275 and 65,536 for IDT72V285.
5.
EF goes HIGH at 60ns + 1 RCLK cycle + tREF.
Figure 11. Retransmit Timing (IDT Standard Mode)
tREF
tRTS
tENH
4512 drw 14
tA
tENS
Wx
WCLK
RCLK
REN
RT
EF
PAF
HF
PAE
Q0 - Qn
tSKEW2
12
1
W1
tPAF
tHF
tPAE
tREF
Wx+1
2
W2
tENH
WEN
tENS
tRTS
tENS
tENH
(3)
tA
(3)
(5)
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PDF描述
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參數(shù)描述
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