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參數(shù)資料
| 型號(hào)： | 668-0011 |
| 廠商： | Rabbit Semiconductor |
| 文件頁數(shù)： | 82/312頁 |
| 文件大小： | 0K |
| 描述： | IC MPU RABIT3000A 55.5MHZ128LQFP |
| 標(biāo)準(zhǔn)包裝： | 2 |
| 系列： | Rabbit 3000 |
| 處理器類型： | Rabbit 3000 8-位 |
| 速度： | 55.5MHz |
| 電壓： | 2.5V，2.7V，3V，3.3V |
| 安裝類型： | 表面貼裝 |
| 封裝/外殼： | 128-LQFP |
| 供應(yīng)商設(shè)備封裝： | 100-LQFP（14x14） |
| 包裝： | 托盤 |
| 其它名稱： | 316-1043 |
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Rabbit 3000 Microprocessor User’s Manual
19.3.3 Master/Slave Communication
1. The master writes data to the appropriate external I/O address on the data bus for the
slave device and register desired. For example, in the setup described here, the master
would write to register SPD2R on the first slave by writing to the address 0xC002
(0xC000 for the I6 strobe, and 0x0002 for SPD2R on that slave).
2. If the master is writing multiple bytes, it should write to SPD0R last since that will
trigger an interrupt on the slave device. If only one byte is being sent, it should be
written to SPD0R.
3. The slave responds to the interrupt, reading the data from the slave port data registers.
19.3.4 Slave/Master Communication
1. The slave writes data to the appropriate slave port data register. If it is writing multiple
bytes, SPD0R should be written last, which enables the /SLAVEATTN line.
2. The master receives an external interrupt from the /SLAVEATTN line, and reads the
data out of the slave port data registers via external I/O reads on the data bus.
19.3.5 Handling Interrupts
The interrupt request on the slave is cleared by either the master or the slave accessing one
of the slave port registers. To clear the interrupt without affecting the register values, a
dummy write can be made to SPSR.
19.3.6 Example ISR
A sample interrupt handler is shown below.
slave_isr::
push af
; save used registers
; read the data sent by the master
ioi ld a, (SPD2R)
ld (to_slv_d2), a
ioi ld a, (SPD1R)
ld (to_slv_d1), a
ioi ld a, (SPD0R)
ld (to_slv_d0), a
; if a response is required, perform it here
ld a, (to_mas_d2)
ioi ld (SPD2R), a
ld a, (to_mas_d1)
ioi ld (SPD1R), a
ld a, (to_mas_d0)
ioi ld (SPD0R), a
; this write asserts /SLVATTN
; the interrupt request is cleared by any read/write of the registers
pop af
; restore used registers
ipres
ret
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