VERSACLOCK LOW POWER CLOCK GENERATOR EEPROM CLOCK GENERATOR
參數(shù)資料
型號： 5P49EE502NDGI
廠商： IDT, Integrated Device Technology Inc
文件頁數(shù)： 21/26頁
文件大?。?/td> 0K
描述： IC CLOCK GENERATOR 20QFN
標(biāo)準(zhǔn)包裝： 100
系列： VersaClock™
類型： 時鐘發(fā)生器
PLL： 帶旁路
輸入： LVTTL，晶體
輸出： LVCMOS，LVTTL
電路數(shù)： 1
比率 - 輸入:輸出： 1:5
差分 - 輸入:輸出： 無/無
頻率 - 最大： 120MHz
除法器/乘法器： 是/無
電源電壓： 1.71 V ~ 1.89 V
工作溫度： -40°C ~ 85°C
安裝類型： 表面貼裝
封裝/外殼： 20-VFQFN 裸露焊盤
供應(yīng)商設(shè)備封裝： 20-VFQFPN（3x3）
包裝： 管件
其它名稱： 800-2522
IDT5P49EE502
VERSACLOCK LOW POWER CLOCK GENERATOR
EEPROM CLOCK GENERATOR
IDT VERSACLOCK LOW POWER CLOCK GENERATOR
4
IDT5P49EE502
REV L 072512
Note *: SEL pins should be controlled by 1.8V LVTTL logic; 3.3V tolerant.
Note 1: Outputs are user programmable to drive single-ended 1.8V/2.5V/3.3V LVTTL as indicated above. Always
completely power up VDD and VDDx prior to applying VDDO power.
Note 2: Default configuration CLK3=Buffered Reference output. All other outputs are off.
Note 3: Do not power up with SEL[1:0] = 00 (in Power down/Sleep mode).
Ideal Power Up Sequence
Ideal Power Down Sequence
SCLK
14
I
LVTTL
I2C clock. Logic levels set by VDDO1. 5V tolerant.
OUT0
15
O
Adjustable
Configurable clock output 0. Single-ended output voltage levels
are register controlled by either VDDO1 or VDDO2.
OUT4
16
O
Adjustable
Configurable clock output 8. Single-ended output voltage levels
controlled by VDDO2.
SDA
17
I/O
Open Drain
Bidirectional I2C data. Logic levels set by VDDO1. 5V tolerant.
VDDO2
18
Power
Device power supply. Connect to 1.8 to 3.3V. Using register
settings, select output voltage levels for OUT0-OUT4.
VDD
19
Power
Device power supply. Connect to 1.8V.
GND
20
Power
Connect to Ground.
V
t
VDD, VDDx
VDDO1
VDDO2, VDDO3
1) VDD and VDDx must come up first, followed by VDDO
2) VDDO1 must come up within 1ms after VDD and VDDX come up
3) VDDO2 must be equal to, or lower than, VDDO1
4) VDD and VDDx have approx. the same ramp rate
5) VDDO1 and VDDO2 have approx. same ramp rate
1 ms
V
t
VDD, VDDx
VDDO1
1) VDDO must drop first, followed by VDD and VDDx
2) VDD and VDDx must come down within 1ms after VDDO1 comes down
3) VDDO2 must be equal to, or lower than, VDDO1
4) VDD and VDDx have approx. the same ramp rate
5) VDDO1 and VDDO2 have approx. same ramp rate
VDDO2, VDDO3
1 ms
相關(guān)PDF資料
PDF描述
5P49EE802NDGI IC CLOCK GENERATOR 28QFN
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參數(shù)描述
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5P49EE515NDGI8 功能描述:IC CLOCK GENERATOR 20QFN 制造商:idt, integrated device technology inc 系列:VersaClock? 包裝:帶卷（TR） 零件狀態(tài):有效 類型:* PLL:無 輸入:晶體 輸出:LVCMOS，LVTTL 電路數(shù):1 比率 - 輸入:輸出:1：5 差分 - 輸入:輸出:無/無 頻率 - 最大值:120MHz 分頻器/倍頻器:是/無 電壓 - 電源:1.71 V ~ 3.465 V 工作溫度:-40°C ~ 85°C 安裝類型:表面貼裝 封裝/外殼:20-VFQFN 裸露焊盤 供應(yīng)商器件封裝:20-QFN（3x3） 標(biāo)準(zhǔn)包裝:2,500
5P49EE601NLGI 功能描述:時鐘發(fā)生器及支持產(chǎn)品 VERSACLOCK LOW POWER PLL RoHS:否 制造商:Silicon Labs 類型:Clock Generators 最大輸入頻率:14.318 MHz 最大輸出頻率:166 MHz 輸出端數(shù)量:16 占空比 - 最大:55 % 工作電源電壓:3.3 V 工作電源電流:1 mA 最大工作溫度:+ 85 C 安裝風(fēng)格:SMD/SMT 封裝 / 箱體:QFN-56
5P49EE601NLGI8 功能描述:時鐘發(fā)生器及支持產(chǎn)品 VERSACLOCK LOW POWER PLL RoHS:否 制造商:Silicon Labs 類型:Clock Generators 最大輸入頻率:14.318 MHz 最大輸出頻率:166 MHz 輸出端數(shù)量:16 占空比 - 最大:55 % 工作電源電壓:3.3 V 工作電源電流:1 mA 最大工作溫度:+ 85 C 安裝風(fēng)格:SMD/SMT 封裝 / 箱體:QFN-56
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