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參數資料
| 型號： | μPD78F9418 |
| 廠商： | NEC Corp. |
| 英文描述： | 8 Bit Single Chip Microcontrollers(8位單片微控制器) |
| 中文描述： | 8位單片機微控制器（8位單片微控制器） |
| 文件頁數： | 32/128頁 |
| 文件大?。?/td> | 614K |
| 代理商： | ΜPD78F9418 |
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32
μ
PD78F9418
6.2.3
Clock generator control registers
The clock generator is controlled using the following registers.
Processor clock control register (PCC)
Suboscillation mode register (SCKM)
Subclock control register (CSS)
(1) Processor clock control register (PCC)
The PCC selects a CPU clock and specifies a corresponding frequency division ratio.
It is manipulated using a 1-bit or 8-bit memory manipulation instruction.
A RESET input loads 02H into the PCC.
Figure 6-8. Processor Clock Control Register Format
Control of main system clock oscillator operation
MCC
0
0
0
0
0
PCC1
0
PCC
Symbol
Address
When reset
R/W
FFFBH
02H
R/W
7
6
5
4
3
2
1
0
MCC
0
1
Operation enabled
Operation disabled
CPU clock (f
CPU
) selection
Note
CSS0
0
0
1
1
f
X
f
X
/2
2
f
XT
/2
PCC1
0
1
0
1
(0.2 s)
(0.8 s)
(61 s)
Note
A CPU clock is selected by a combination of the PCC1 flag in the processor clock control register (PCC)
and the CSS0 flag in the subclock control register (CSS). (See
(3)
in
Section 6.2.3
.)
Caution Bit 0 and bits 2 to 6 must be fixed to 0.
Remarks 1.
f
X
: Main system clock oscillation frequency
2.
f
XT
: Subsystem clock oscillation frequency
3.
The parenthesized values apply to operation with f
X
= 5.0 MHz or f
XT
= 32.768 kHz.
4.
Minimum instruction execution time: 2 f
CPU
f
CPU
= 0.2
μ
s : 0.4
μ
s
f
CPU
= 0.8
μ
s : 1.6
μ
s
f
CPU
= 61
μ
s : 122
μ
s
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PDF描述 |
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參數描述 |
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