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參數(shù)資料
| 型號(hào)： | XRD9827ACDTR-F |
| 廠商： | Exar Corporation |
| 文件頁(yè)數(shù)： | 2/36頁(yè) |
| 文件大小： | 0K |
| 描述： | IC 12B CCD/CIS SIG PROC 20SOIC |
| 產(chǎn)品變化通告： | Obsolescence Notification 15/Apr/2010 |
| 標(biāo)準(zhǔn)包裝： | 1,000 |
| 位數(shù)： | 12 |
| 通道數(shù)： | 3 |
| 電壓 - 電源，模擬： | 3 V ~ 5.5V |
| 電壓 - 電源，數(shù)字： | 3 V ~ 5.5 V |
| 封裝/外殼： | 20-SOIC（0.295"，7.50mm 寬） |
| 供應(yīng)商設(shè)備封裝： | 20-SOIC W |
| 包裝： | 帶卷 (TR) |
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XRD9827
10
Rev. 3.00
ELECTRICAL CHARACTERISTICS (CONT'D)
Test Conditions: AV
DD=DVDD= 3V, ADCCLK=6MHz, 50% Duty Cycle, TA=25°C unless otherwise specified.
Symbol
Parameter
Min.
Typ.
Max.
Unit
Conditions
System Specifications (MUX + Buffer + PGA + ADC)
Note 1
SYS
DNL
System DNL
-1.0
±0.5
+6.0
LSB
AV
DD = DVDD = 3.0V
SYS
LIN
System Linearity
±6.0
LSB
SYS
GE
System Gain Error
-5.0
+5.0
%
IRN
Input Referred Noise
1.5
mV
rms
Gain=1
Input Referred Noise
0.5
mV
rms
Gain=10
System Timing Specifications
tcklw
ADCCLK Low Pulse Width
50
83
ns
tckhw
ADCCLK High Pulse Width
70
83
ns
tckpd
ADCCLK Period
120
166
ns
tsypw
SYNCH Pulse Width
30
ns
trars
Rising ADCCLK to rising
0
SYNCH must rise equal to
SYNCH
or after ADCCLK, See Figure 18
tclpw
CLAMP Pulse Width
30
ns
Note 2
Write Timing Specifications
tsclkw
SCLK Pulse Width
40
ns
tdz
LD Low to SCLK High
20
ns
tds
Input Data Set-up Time
20
ns
tdh
Input Data Hold Time
0
ns
tdl
SCLK High to LD High
50
ns
ADC Digital Output Specifications
tap
Aperture Delay
15
ns
tdv
Output Data Valid
30
50
ns
tsa
SYNCH to ADCCLK
20
ns
3ch Pixel Md
tlat
Latency
8
cycles
Config 00, 11
tlat
Latency
6
pixels
Config 01, 10
Digital Input Specifications
V
IH
Input High Voltage
AV
DD-0.5
V
IL
Input Low Voltage
1
V
I
IH
High Voltage Input Current
5
A
I
IL
Low Voltage Input Current
5
A
C
IN
Input Capacitance
10
pF
Note 1:
System performance is specified for typical digital system timing specifications.
Note 2:
The actual minimum ‘tclpw’ is dependent on the external capacitor value, the CIS output impedance.
During ‘clamp’ operation, sufficient time needs to be allowed for the external capacitor to charge up to the
correct operating level. Refer to the description in Theory of Operation, CIS Config.
相關(guān)PDF資料 |
PDF描述 |
|---|---|
| XRD9827ACD-F | IC 12B CCD/CIS SIG PROC 20SOIC |
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| XRD9826ACD-F | IC 16B CCD/CIS SIG PROC 20SOIC |
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相關(guān)代理商/技術(shù)參數(shù) |
參數(shù)描述 |
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| XRD9827ACU | 功能描述:模數(shù)轉(zhuǎn)換器 - ADC RoHS:否 制造商:Texas Instruments 通道數(shù)量:2 結(jié)構(gòu):Sigma-Delta 轉(zhuǎn)換速率:125 SPs to 8 KSPs 分辨率:24 bit 輸入類型:Differential 信噪比:107 dB 接口類型:SPI 工作電源電壓:1.7 V to 3.6 V, 2.7 V to 5.25 V 最大工作溫度:+ 85 C 安裝風(fēng)格:SMD/SMT 封裝 / 箱體:VQFN-32 |
| XRD9827ACU-F | 功能描述:模數(shù)轉(zhuǎn)換器 - ADC RoHS:否 制造商:Texas Instruments 通道數(shù)量:2 結(jié)構(gòu):Sigma-Delta 轉(zhuǎn)換速率:125 SPs to 8 KSPs 分辨率:24 bit 輸入類型:Differential 信噪比:107 dB 接口類型:SPI 工作電源電壓:1.7 V to 3.6 V, 2.7 V to 5.25 V 最大工作溫度:+ 85 C 安裝風(fēng)格:SMD/SMT 封裝 / 箱體:VQFN-32 |
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| XRD9828 | 制造商:EXAR 制造商全稱:EXAR 功能描述:10-Bit Linear CIS/CCD Sensor Signal Processor with Parallel Interface |
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