參數(shù)資料
型號： XRD9824ACU
廠商： Exar Corporation
文件頁數(shù)： 4/32頁
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描述： IC 14B CCD/CIS SIG PROC 20SSOP
產(chǎn)品變化通告： Leaded UART, V&I Obsolescence 11/Apr/2011
標(biāo)準(zhǔn)包裝： 66
位數(shù)： 14
通道數(shù)： 3
電壓 - 電源，模擬： 3 V ~ 5.5V
電壓 - 電源，數(shù)字： 3 V ~ 5.5 V
封裝/外殼： 20-SSOP（0.209"，5.30mm 寬）
供應(yīng)商設(shè)備封裝： 20-SSOP
包裝： 管件
XRD9824
12
Rev. 2.00
CIS Mode Timing -- DC Coupled
(CLAMP disabled)
ADCCLK
tckhw
tcklw
tckpd
tap
Pixel N-1
Pixel N
tdv
Pixel N+1
CIS
tdv
[5:0]
[11:6]
N-8
MSB
N-8
LSB
N-7
MSB
N-7
LSB
N-6
MSB
N-6
LSB
N-5
MSB
N-5
LSB
DB
Figure 6. Timing Diagram for Figure 5
ADCCLK
Events
↓
ADC Sample & PGA Start Tracking next Pixel
MSB Data Out
↑
LSB Data Out
HI
ADC Track PGA Output
LO
ADC Hold/Convert
Table 1.
Mode 2. AC Coupled
If the CIS signal has a black reference for the video
signal, an external capacitor C
EXT is used.
When
CLAMP (clamp) pin is set high an internal switch allows
one side of the external capacitor to be set to ground.
It then is level shifted to correspond to the bottom
ladder reference voltage of the ADC (Figure 7).
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PDF描述
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