參數(shù)資料
型號(hào)： XCCACE128-I
廠商： Xilinx Inc
文件頁(yè)數(shù)： 7/69頁(yè)
文件大?。?/td> 0K
描述： IC 128MBIT ACE FLASH CARD
標(biāo)準(zhǔn)包裝： 1
存儲(chǔ)容量： 128Mb
存儲(chǔ)器類型： FLASH
System ACE CompactFlash Solution
DS080 (v3.0) April 7, 2014
15
Product Specification
R
— OBSOLETE — OBSOLETE — OBSOLETE — OBSOLETE —
Multiple Register Read Timing
The minimum timing requirements for sequential register read cycles are shown in Figure 11. Sequential read cycles are
identical to single read cycles, except that the chip enable (MPCE) and write enable (MPWE) signals do not need to be
de-asserted between read cycles.
Figure 11: Multiple WORD Reads From ACE Register(s)
50ns
100ns
150ns
200ns
250
0
CYCLE
CLK
MPA
MPD
MPCE
MPWE
MPOE
Cycle 0
Cycle 1
Cycle 2
Cycle 3
Cycle 4
Cycle 5
Cycle 6
Cycle 7
ADDRESS <0>
ADDRESS <1>
DATA <0>
DATA <1>
tSA
tSCE
tSWE
tDD
tDOE
tH
tDOE
tSOE
tH
tSOE
tH
tSA
tDOE
tH
tSOE
tDOE
tH
tSOE
tDD
tH
DS080_16_013101
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PDF描述
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