參數(shù)資料
型號： XC95288-15HQ208C
廠商： Xilinx Inc
文件頁數(shù)： 8/12頁
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描述： IC CPLD SPEED GRADE 208-HQFP/COM
產(chǎn)品變化通告： XC1700 PROMs,XC5200,HQ,SCD Parts Discontinuation 19/Jul/2010
標準包裝： 24
系列： XC9500
可編程類型： 系統(tǒng)內(nèi)可編程（最少 10,000 次編程/擦除循環(huán)）
最大延遲時間 tpd(1)： 15.0ns
電壓電源 - 內(nèi)部： 4.75 V ~ 5.25 V
邏輯元件/邏輯塊數(shù)目： 16
宏單元數(shù)： 288
門數(shù)： 6400
輸入/輸出數(shù)： 168
工作溫度： 0°C ~ 70°C
安裝類型： 表面貼裝
封裝/外殼： 208-BFQFP 裸露焊盤
供應(yīng)商設(shè)備封裝： 208-PQFP（28x28）
包裝： 托盤
其它名稱： Q1090654
XC95288 In-System Programmable CPLD
DS069 (v5.0) May 17, 2013
Product Specification
5
R
Product Obsolete/Under Obsolescence
Internal Timing Parameters
Symbol
Parameter
XC95288-15
XC95288-20
Units
Min
Max
Min
Max
Buffer Delays
TIN
Input buffer delay
-
4.5
-
6.5
ns
TGCK
GCK buffer delay
-
3.0
-
3.0
ns
TGSR
GSR buffer delay
-
7.5
-
9.5
ns
TGTS
GTS buffer delay
-
11.0
-
16.0
ns
TOUT
Output buffer delay
-
4.5
-
6.5
ns
TEN
Output buffer enable/disable delay
-
0
-
0
ns
Product Term Control Delays
TPTCK
Product term clock delay
-
2.5
-
2.5
ns
TPTSR
Product term set/reset delay
-
3.0
-
3.0
ns
TPTTS
Product term 3-state delay
-
5.0
-
5.0
ns
Internal Register and Combinatorial Delays
TPDI
Combinatorial logic propagation delay
-
3.0
-
4.0
ns
TSUI
Register setup time
3.5
-
3.5
-
ns
THI
Register hold time
4.5
-
6.5
-
ns
TCOI
Register clock to output valid time
-
0.5
-
0.5
ns
TAOI
Register async. S/R to output delay
-
8.0
-
8.0
ns
TRAI
Register async. S/R recover before clock
10.0
-
10.0
-
ns
TLOGI
Internal logic delay
-
3.0
-
3.0
ns
TLOGILP Internal low power logic delay
-
11.5
-
11.5
ns
Feedback Delays
TF
FastCONNECT feedback delay
-
11.0
-
13.0
ns
TLF
Function block local feedback delay
-
3.5
-
5.0
ns
Time Adders
TPTA(1)
Incremental product term allocator delay
-
1.0
-
1.5
ns
TSLEW
Slew-rate limited delay
-
5.0
-
5.5
ns
Notes:
1.
TPTA is multiplied by the span of the function as defined in the XC9500 family data sheet.
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PDF描述
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