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參數(shù)資料
| 型號： | XC2C64A-7QFG48I |
| 廠商： | Xilinx Inc |
| 文件頁數(shù)： | 15/16頁 |
| 文件大小： | 0K |
| 描述： | IC CR-II CPLD 64MCELL 48QFN |
| 標(biāo)準(zhǔn)包裝： | 260 |
| 系列： | CoolRunner II |
| 可編程類型： | 系統(tǒng)內(nèi)可編程 |
| 最大延遲時(shí)間 tpd(1)： | 6.7ns |
| 電壓電源 - 內(nèi)部： | 1.7 V ~ 1.9 V |
| 邏輯元件/邏輯塊數(shù)目： | 4 |
| 宏單元數(shù)： | 64 |
| 門數(shù)： | 1500 |
| 輸入/輸出數(shù)： | 37 |
| 工作溫度： | -40°C ~ 85°C |
| 安裝類型： | 表面貼裝 |
| 封裝/外殼： | 48-VFQFN 裸露焊盤 |
| 供應(yīng)商設(shè)備封裝： | 48-QFN-EP（7x7） |
| 包裝： | 托盤 |
CoolRunner-II CPLD Family
8
DS090 (v3.1) September 11, 2008
Product Specification
R
nally generated DataGATE control logic can be assigned to
this I/O pin with the BUFG=DATA_GATE attribute.
Global Signals
Global signals, clocks (GCK), sets/resets (GSR), and output
enables (GTS), are designed to strongly resemble each
other. This approach enables design software to make the
best utilization of their capabilities. Each global capability is
supplemented by a corresponding product term version.
Figure 7 shows the common structure of the global signal
trees. The pin input is buffered, then drives multiple internal
global signal traces to deliver low skew and reduce loading
delays. GCK, GSR, and GTS can also be used as general
purpose I/Os if they are not needed as global signals. The
DataGATE assertion rail is also a global signal.
Figure 6: DataGATE Architecture (output drivers not shown)
PLA
MC1
MC2
MC16
DS090_06_111201
PLA
DataGATE Assertion Rail
PLA
AIM
MC1
MC2
MC16
MC1
MC2
MC16
MC1
MC2
MC16
To AIM
Latch
To AIM
Latch
To AIM
Latch
To AIM
Latch
Figure 7: Global Clocks (GCK), Sets/Resets (GSR), and
Output Enables (GTS)
DS090_07_101001
相關(guān)PDF資料 |
PDF描述 |
|---|---|
| TAJB475M025A | CAP TANT 4.7UF 25V 20% 1210 |
| GSM02DREN | CONN EDGECARD 4POS .156 EYELET |
| IRU1010CY | IC REG LDO ADJ 1A SOT-223 |
| IRU1010CS | IC REG LDO ADJ 1A 8-SOIC |
| XA9572XL-15VQG44I | IC CPLD 3.3V 72MCELL 44-VQFP |
相關(guān)代理商/技術(shù)參數(shù) |
參數(shù)描述 |
|---|---|
| XC2C64A-7VQ100C | 制造商:Xilinx 功能描述:CPLD COOLRUNNER-II 1.5K GATES 64 MCRCLLS 300MHZ 0.18UM 1.8V - Trays 制造商:Xilinx 功能描述:IC CPLD 64MC 6.7NS 100VQFP 制造商:Xilinx 功能描述:IC CR-II CPLD 64MCELL 100-VQFP |
| XC2C64A-7VQ100I | 制造商:Xilinx 功能描述:CPLD COOLRUNNER-II 1.5K GATES 64 MCRCLLS 300MHZ 0.18UM 1.8V - Trays 制造商:Xilinx 功能描述:IC CR-II CPLD 64MCELL 100-VQFP 制造商:Xilinx 功能描述:IC CPLD 64MC 6.7NS 100VQFP |
| XC2C64A-7VQ44C | 制造商:Xilinx 功能描述:CPLD COOLRUNNER-II 1.5K GATES 64 MCRCLLS 300MHZ 0.18UM 1.8V - Trays 制造商:Xilinx 功能描述:IC CR-II CPLD 64MCELL 44-VQFP 制造商:Xilinx 功能描述:IC CPLD 64MC 6.7NS 44VQFP |
| XC2C64A-7VQ44I | 制造商:Xilinx 功能描述:CPLD COOLRUNNER-II 1.5K GATES 64 MCRCLLS 300MHZ 0.18UM 1.8V - Trays 制造商:Xilinx 功能描述:IC CR-II CPLD 64MCELL 44-VQFP 制造商:Xilinx 功能描述:IC CPLD 64MC 6.7NS 44VQFP |
| XC2C64A-7VQG100C | 功能描述:IC CR-II CPLD 64MCELL 100-VQFP RoHS:是 類別:集成電路 (IC) >> 嵌入式 - CPLD（復(fù)雜可編程邏輯器件） 系列:CoolRunner II 標(biāo)準(zhǔn)包裝:90 系列:ispMACH® 4A 可編程類型:系統(tǒng)內(nèi)可編程 最大延遲時(shí)間 tpd(1):7.5ns 電壓電源 - 內(nèi)部:4.75 V ~ 5.25 V 邏輯元件/邏輯塊數(shù)目:- 宏單元數(shù):64 門數(shù):- 輸入/輸出數(shù):48 工作溫度:0°C ~ 70°C 安裝類型:表面貼裝 封裝/外殼:100-LQFP 供應(yīng)商設(shè)備封裝:100-TQFP（14x14） 包裝:托盤 |
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