參數資料
型號： XA2C64A-7VQG44I
廠商： Xilinx Inc
文件頁數： 14/16頁
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描述： IC CPLD 64MCELL 33 I/O 44-VQFP
產品培訓模塊： CoolRunner-II CPLD Starter Kit
標準包裝： 160
系列： CoolRunner II
可編程類型： 系統內可編程
最大延遲時間 tpd(1)： 6.7ns
電壓電源 - 內部： 1.7 V ~ 1.9 V
邏輯元件/邏輯塊數目： 4
宏單元數： 64
門數： 1500
輸入/輸出數： 33
工作溫度： -40°C ~ 85°C
安裝類型： 表面貼裝
封裝/外殼： 44-TQFP
供應商設備封裝： 44-VQFP（10x10）
包裝： 托盤
XA2C64A CoolRunner-II Automotive CPLD
DS553 (v1.1) May 5, 2007
7
Product Specification
R
Internal Timing Parameters
Symbol
Parameter(1)
-7
-8
Units
Min.
Max.
Min.
Max.
Buffer Delays
TIN
Input buffer delay
-
2.4
-
2.4
ns
TDIN
Direct data register input delay
-
4.0
-
3.7
ns
TGCK
Global clock buffer delay
-
2.5
-
2.5
ns
TGSR
Global set/reset buffer delay
-
3.5
-
3.5
ns
TGTS
Global 3-state buffer delay
-
3.9
-
3.9
ns
TOUT
Output buffer delay
-
2.8
-
2.8
ns
TEN
Output buffer enable/disable delay
-
6.1
-
6.1
ns
P-term Delays
TCT
Control term delay
-
2.5
-
2.5
ns
TLOGI1
Single P-term delay adder
-
0.8
-
0.8
ns
TLOGI2
Multiple P-term delay adder
-
0.8
-
0.8
ns
Macrocell Delay
TPDI
Input to output valid
-
0.7
-
0.7
ns
TLDI
Setup before clock (transparent latch)
-
2.5
-
2.5
ns
TSUI
Setup before clock
1.8
-
2.1
-
ns
THI
Hold after clock
0.0
-
0.0
-
ns
TECSU
Enable clock setup time
1.3
-
1.3
-
ns
TECHO
Enable clock hold time
0.0
-
0.0
-
ns
TCOI
Clock to output valid
-
0.7
-
0.7
ns
TAOI
Set/reset to output valid
-
2.0
-
2.0
ns
Feedback Delays
TF
Feedback delay
-
3.0
-
3.0
ns
TOEM
Macrocell to global OE delay
-
1.7
-
1.7
ns
I/O Standard Time Adder Delays 1.5VCMOS
THYS15
Hysteresis input adder
-
6.0
-
6.0
ns
TOUT15
Output adder
-
1.5
-
1.5
ns
TSLEW15
Output slew rate adder
-
6.0
-
6.0
ns
I/O Standard Time Adder Delays 1.8V CMOS
THYS18
Hysteresis input adder
-
4.0
-
4.0
ns
TOUT18
Output adder
-
0.0
-
0.0
ns
TSLEW
Output slew rate adder
-
5.0
-
5.0
ns
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