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參數資料
| 型號： | UPD78F1165AGC-UEU-AX |
| 廠商： | Renesas Electronics America |
| 文件頁數： | 150/966頁 |
| 文件大?。?/td> | 0K |
| 描述： | MCU 16BIT 78K0R/KX3 100-LQFP |
| 標準包裝： | 300 |
| 系列： | 78K0R/Kx3 |
| 核心處理器： | 78K/0R |
| 芯體尺寸： | 16-位 |
| 速度： | 20MHz |
| 連通性： | 3 線 SIO，I²C，LIN，UART/USART |
| 外圍設備： | DMA，LVD，POR，PWM，WDT |
| 輸入/輸出數： | 83 |
| 程序存儲器容量： | 192KB（192K x 8） |
| 程序存儲器類型： | 閃存 |
| RAM 容量： | 10K x 8 |
| 電壓 - 電源 (Vcc/Vdd)： | 1.8 V ~ 5.5 V |
| 數據轉換器： | A/D 16x10b; D/A 2x8b |
| 振蕩器型： | 內部 |
| 工作溫度： | -40°C ~ 85°C |
| 封裝/外殼： | 100-LQFP |
| 包裝： | 托盤 |
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CHAPTER 7 TIMER ARRAY UNIT
User’s Manual U17894EJ9V0UD
231
7.2 Configuration of Timer Array Unit
The timer array unit includes the following hardware.
Table 7-1. Configuration of Timer Array Unit
Item
Configuration
Timer/counter
Timer counter register 0n (TCR0n)
Register
Timer data register 0n (TDR0n)
Timer input
TI00 to TI07 pins, RxD3 pin (for LIN-bus)
Timer output
TO00 to TO07 pins, output controller
<Registers of unit setting block>
Peripheral enable register 0 (PER0)
Timer clock select register 0 (TPS0)
Timer channel enable status register 0 (TE0)
Timer channel start register 0 (TS0)
Timer channel stop register 0 (TT0)
Timer input select register 0 (TIS0)
Timer output enable register 0 (TOE0)
Timer output register 0 (TO0)
Timer output level register 0 (TOL0)
Timer output mode register 0 (TOM0)
Control registers
<Registers of each channel>
Timer mode register 0n (TMR0n)
Timer status register 0n (TSR0n)
Input switch control register (ISC) (channel 7 only)
Noise filter enable register 1 (NFEN1)
Port mode registers 0, 1, 3, 4, 13, 14 (PM0, PM1, PM3, PM4, PM13, PM14)
Port registers 0, 1, 3, 4, 13, 14 (P0, P1, P3, P4, P13, P14)
Remark
n: Channel number (n = 0 to 7)
Figure 7-1 shows the block diagram.
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