Reception is enabled and the R" />
參數(shù)資料
型號(hào)： UPD78F0394GC-8EA-A
廠商： Renesas Electronics America
文件頁數(shù)： 258/682頁
文件大?。?/td> 0K
描述： MCU 8BIT 48KB FLASH
標(biāo)準(zhǔn)包裝： 400
系列： 78K0/Lx2
核心處理器： 78K/0
芯體尺寸： 8-位
速度： 20MHz
連通性： 3 線 SIO，I²C，LIN，UART/USART
外圍設(shè)備： LCD，LVD，POR，PWM，WDT
輸入/輸出數(shù)： 40
程序存儲(chǔ)器容量： 48KB（48K x 8）
程序存儲(chǔ)器類型： 閃存
RAM 容量： 2K x 8
電壓 - 電源 (Vcc/Vdd)： 1.8 V ~ 5.5 V
數(shù)據(jù)轉(zhuǎn)換器： A/D 8x10b
振蕩器型： 內(nèi)部
工作溫度： -40°C ~ 85°C
封裝/外殼： 100-LQFP
包裝： 托盤
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CHAPTER 14 SERIAL INTERFACE UART0
User’s Manual U17473EJ2V0UD
328
(d) Reception
Reception is enabled and the RXD0 pin input is sampled when bit 7 (POWER0) of asynchronous serial
interface operation mode register 0 (ASIM0) is set to 1 and then bit 5 (RXE0) of ASIM0 is set to 1.
The 5-bit counter of the baud rate generator starts counting when the falling edge of the RXD0 pin input is
detected. When the set value of baud rate generator control register 0 (BRGC0) has been counted, the
RXD0 pin input is sampled again (
in Figure 14-9). If the RXD0 pin is low level at this time, it is recognized
as a start bit.
When the start bit is detected, reception is started, and serial data is sequentially stored in receive shift
register 0 (RXS0) at the set baud rate. When the stop bit has been received, the reception completion
interrupt (INTSR0) is generated and the data of RXS0 is written to receive buffer register 0 (RXB0). If an
overrun error (OVE0) occurs, however, the receive data is not written to RXB0.
Even if a parity error (PE0) occurs while reception is in progress, reception continues to the reception
position of the stop bit, and an reception error interrupt (INTSR0) is generated after completion of reception.
INTSR0 occurs upon completion of reception and in case of a reception error.
Figure 14-9. Reception Completion Interrupt Request Timing
RXD0 (input)
INTSR0
Start
D0
D1
D2
D3
D4
D5
D6
D7
Parity
Stop
RXB0
Cautions 1. If a reception error occurs, read asynchronous serial interface reception error status
register 0 (ASIS0) and then read receive buffer register 0 (RXB0) to clear the error flag.
Otherwise, an overrun error will occur when the next data is received, and the reception
error status will persist.
2. Reception is always performed with the “number of stop bits = 1”. The second stop bit
is ignored.
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PDF描述
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參數(shù)描述
UPD78F0395GC(R)-8EA-A 制造商:Renesas Electronics Corporation 功能描述:
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