PD720113 Timing Diagram Figure 2-13. Hub Differential Delay, Differential J" />
參數(shù)資料
型號(hào)： UPD720113GK-9EU-A
廠商： Renesas Electronics America
文件頁數(shù)： 19/34頁
文件大小： 0K
描述： IC HUB CTLR USB2.0 7-PORTS QFP
標(biāo)準(zhǔn)包裝： 50
控制器類型： USB 2.0 集線器控制器
接口： USB 2.0
電源電壓： 2.5 V，3.3 V
工作溫度： 0°C ~ 70°C
安裝類型： 表面貼裝
封裝/外殼： 80-TQFP
供應(yīng)商設(shè)備封裝： 80-TQFP
包裝： 托盤
Data Sheet S16618EJ3V0DS
24
PD720113
Timing Diagram
Figure 2-13. Hub Differential Delay, Differential Jitter, and SOP Distortion
C. Upstream Hub Delay with or without Cable
D. Measurement Points
50% Point of
Initial Swing
50% Point of
Initial Swing
Upstream
End of
Cable
Upstream
Port of Hub
Downstream
Port of Hub
Downstream
Port of Hub
Downstream
Port of Hub
Upstream Port
or
End of Cable
A. Downstream Hub Delay with Cable
B. Downstream Hub Delay without Cable
Hub Delay
Downstream
tHDD1
Hub Delay
Upstream
tHDD1
tHDD2
Crossover
Point
Crossover
Point
Crossover
Point
VSS
Hub Differential Jitter:
tHDJ1 = tHDDx(J)
tHDDx(K) or tHDDx(K) tHDDx(J) Consecutive Transitions
tHDJ2 = tHDDx(J)
tHDDx(J) or tHDDx(K) tHDDx(K) Paired Transitions
Bit after SOP Width Distortion (same as data jitter for SOP and next J transition):
tFSOP = tHDDx(next J)
tHDDx(SOP)
Low-speed timings are determined in the same way for:
tLHDD, tLDHJ1, tLDJH2, tLUHJ1, tLUJH2, and tLSOP
Host or
Hub
Function
Upstream end of cable
Upstream port
Downstream port
Downstream signaling
Upstream signaling
Plug
Receptacle
Hub Delay
Downstream
tHDD2
VSS
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