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參數(shù)資料
| 型號： | UPD70F3114GF-3BA-A |
| 廠商： | NEC Corp. |
| 英文描述： | 32-Bit Single-Chip Microcontrollers |
| 中文描述： | 32位單芯片微控制器 |
| 文件頁數(shù)： | 336/692頁 |
| 文件大?。?/td> | 3176K |
| 代理商： | UPD70F3114GF-3BA-A |
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CHAPTER 9 TIMER/COUNTER FUNCTION
336
User’s Manual U15195EJ5V0UD
(6) Timer 2 output control register 0 (OCTLE0)
The OCTLE0 register controls timer output from the TO2n pin (n = 1 to 4).
This register can be read/written in 16-bit units.
When the higher 8 bits of the OCTLE0 register are used as a OCTLE0H register, and the lower 8 bits are
used as a OCTLE0L register, they can be read/written in 8-bit or 1-bit units.
14
ALVE
4
13
OTME
41
12
OTME
40
2
ALVE
1
3
SWFE
1
4
OTME
20
5
OTME
21
6
ALVE
2
7
SWFE
2
8
OTME
30
9
OTME
31
10
ALVE
3
11
SWFE
3
15
SWFE
4
1
OTME
11
0
OTME
10
OCTLE0
Address
FFFFF648H
After reset
0000H
Bit position
Bit name
Function
15, 11, 7, 3
SWFEn
Fixes the TO2n pin output level according to the setting of ALVEn bit.
0: Output level not fixed.
1: When ALVEn = 0, output level fixed to low level.
When ALVEn = 1, output level fixed to high level.
14, 10, 6, 2
ALVEn
Specifies the active level of the TO2n pin output.
0: Active level is high level
1: Active level is low level
Specifies toggle mode.
OTMEn1
OTMEn0
Toggle mode
0
0
Toggle mode 0:
Reverse output level of TO2n output every time a
subchannel n compare match occurs.
0
1
Toggle mode 1:
Upon subchannel n compare match, set TO2n output to
active level, and when TM20 is “0”, set TO2n output to
inactive level.
1
0
Toggle mode 2:
Upon subchannel n compare match, set TO2n output to
active level, and when TM21 is “0”, set TO2n output to
inactive level.
1
1
Toggle mode 3:
Upon subchannel n compare match, set TO2n output to
active level, and upon subchannel n + 1 compare
match, set TO2n output to inactive level (when n = “4”,
n + 1 becomes “1”).
13, 12, 9, 8,
5, 4, 1, 0
OTMEn1,
OTMEn0
Cautions 1.
When the OTMEn1 and OTMEn0 bits = 11 (toggle mode 3), if the
same output delay operation settings are made when setting the
ODLEn2 to ODLEn0 bits of the ODELE0 register, two outputs
change simultaneously upon 1 subchannel n compare match.
2.
If two or more signals are input simultaneously to the same
output circuit, S/T signal input has a higher priority than RA, RB,
and RN signal inputs.
Remark
n = 1 to 4
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