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參數(shù)資料
| 型號(hào)： | UPD70F3107AGJ-UEN |
| 廠商： | NEC Corp. |
| 英文描述： | 32-Bit Single-Chip Microcontrollers |
| 中文描述： | 32位單芯片微控制器 |
| 文件頁(yè)數(shù)： | 63/99頁(yè) |
| 文件大?。?/td> | 528K |
| 代理商： | UPD70F3107AGJ-UEN |
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CHAPTER 4 CONFIGURATION EXAMPLES OF FPGA INTEGRATION
Application Note U17121EJ1V1AN
63
4.5.3 External connection diagram of external bus interface (example of connection with V850E/ME2)
System reset
VBRESETZ
FPGA
(PCI host bridge)
SDRAM1
SDRAM2
RA2 to RA14
RA24, RA25
RD0 to RD31
BENZ0 to BENZ3
WRZ
SDCKE
SDCS
SDRASZ
SDCASZ
SDCLK
RDZ
WAITZ
INT0
HLDRQZ
HLDAKZ
RESET
V850E/ME2
HLDAK
HLDRQ
INTPxxx
WAIT
RD
A0 to A22
A24, A25
D0 to D31
xxBE/xxDQM
WR/WE
SDCKE
CSx
SDRAS
SDCAS
BUSCLK
A0 to A12
BA0, BA1
DQ0 to DQ31
DQM0, DQM1
/WE
CKE
/CS
/RAS
/CAS
CLK
DQM2, DQM3
Remarks 1.
This is an example using two SDRAMs of 4 M words
×
16 bits
×
4 banks (row address: 13 bits,
column address: 9 bits).
2.
xx: LL, LU, UL, UU
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