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參數(shù)資料
| 型號： | UPD17P137AGT |
| 廠商： | NEC Corp. |
| 元件分類： | 4位微控制器 |
| 英文描述： | 4-BIT SINGLE-CHIP MICROCONTROLLER FOR SMALL GENERAL-PURPOSE INFRARED REMOTE CONTROL TRANSMITTER |
| 中文描述： | 4位單片機的小型通用紅外遙控器 |
| 文件頁數(shù)： | 55/292頁 |
| 文件大小： | 754K |
| 代理商： | UPD17P137AGT |
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CHAPTER 6 STACK
36
6.3 ADDRESS STACK REGISTERS (ASRs)
Five 11-bit address stack registers (ASRs) are provided as shown in Figure 6-1. The functions of these registers
are as follows:
Store a return address when the CALL addr or CALL @AR instruction is executed, when the first instruction
cycle of the “MOVT DBF, @AR” instruction is executed, or when an interrupt is accepted.
Store the contents of an address register (AR) when the PUSH AR instruction is executed. The ASR to which
the data is to be stored is specified by decrementing the value of the stack pointer (SP) by one when the
instruction is executed.
Restore the contents of the ASR (return address) specified by the stack pointer to the program counter and
increment the value of the stack pointer by one when the RET or RETSK instruction is executed, when the second
instruction cycle of the “MOVT DBF, @AR” instruction is executed, or when the RETI instruction is executed.
Transfer the value of the ASR specified by the stack pointer to an address register and decrement the value
of the stack pointer by one when the POP AR instruction is executed.
Caution If the stack pointer underflows as a result of executing the CALL addr or CALL @AR instruction
or servicing an interrupt, it is assumed that a hang-up occurs. Consequently, the internal reset
signal is generated, the hardware is initialized, and the program is started from address 0000H.
Remark
The size of the ASR differs depending on the model. The
μ
PD17134A and 17135A have five 10-bit
ASRs, while the
μ
PD17136A, 17137A, 17P136A, and 17P137A have five 11-bit ASRs.
6.4 INTERRUPT STACK REGISTERS (INTSKs)
Three 5-bit interrupt stack registers (INTSKs) are provided as shown in Figure 6-1. The functions of these registers
are as follows:
Five flags (BCD, CMP, CY, Z, and IXE) in the program status word (PSWORD) in the system register (SYSREG)
to be explained shortly are saved to the INTSK when an interrupt occurs. After the flags have been saved, all
the bits of the BANK and PSWORD are cleared to 0.
The contents of INTSK are restored to the PSWORD when the RETI instruction is executed.
INTSK saves data each time an interrupt has been accepted.
Caution If interrupts are accepted exceeding 3 levels, the first data is lost.
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