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參數(shù)資料
| 型號： | UPD16650 |
| 廠商： | NEC Corp. |
| 英文描述： | 120-/128-OUTPUT TFT-LCD GATE DRIVER |
| 中文描述： | 120-/128-OUTPUT的TFT - LCD柵極驅(qū)動器 |
| 文件頁數(shù)： | 9/12頁 |
| 文件大小： | 62K |
| 代理商： | UPD16650 |
μ
PD16650
9
SWITCHING CHARACTERISTICS
(T
A
= –20
°
C to +70
°
C, V
DD
= 20 V, V
EE1
= V
EE2
= –20 V, V
SS
= 0 V, V
CC
= 3.3
±
0.3 V or 5.0
±
0.5 V)
Parameter
STVR and STVL output delay
Driver output delay
Output rise time
Output fall time
Input capacitance
Maximum clock frequency
Conditions
Min.
Typ.
Max.
Unit
C
L
= 20 pF
CLK
→
STVR(STVL)
C
L
= 220 pF
CLK
→
X
n
C
L
= 220 pF, OE: L
→
H
C
L
= 220 pF, OE: H
→
L
C
L
= 220 pF
C
L
= 220 pF
T
A
= 25
°
C
For cascade connection
100
600
600
700
700
700
700
300
300
15
ns
ns
ns
ns
ns
ns
ns
ns
pF
kHz
t
PHL1
t
PLH1
t
PHL2
t
PLH2
t
d1
t
d2
t
THL
t
TLH
C
I
f
φ
X
Symbol
TIMING REQUIREMENTS
(T
A
= –20
°
C to +70
°
C, V
DD
= 20 V, V
EE1
= V
EE2
= –20 V, V
SS
= 0 V, V
CC
= 3.3
±
0.3 V or 5.0
±
0.5 V)
Remark
The logic input rise time (t
r
) and fall time (t
f
) must be within 20 ns (between 10 % and 90 % of the peak
amplitude of the input).
Parameter
Clock pulse high width
Clock pulse low width
Data setup time
Data hold time
Conditions
Min.
Typ.
Max.
Unit
500
500
100
100
ns
ns
ns
ns
Symbol
PW
φ
X
(H)
PW
φ
X
(L)
t
setup
t
hold
Duty = 50 %
Duty = 50 %
STVR(STVL)
↑ →
CLK
↑
CLK
↑ →
STVR(STVL)
↓
相關PDF資料 |
PDF描述 |
|---|---|
| UPD16650N | 120-/128-OUTPUT TFT-LCD GATE DRIVER |
| UPD16655N-XXX | LCD Display Driver |
| UPD16655 | 240-OUTPUT TFT-LCD GATE DRIVER |
| UPD16655N | 240-OUTPUT TFT-LCD GATE DRIVER |
| UPD16664N-001 | 144/160/184/208-OUTPUT LCD COLUMN SEGMENT DRIVER WITH RAM |
相關代理商/技術參數(shù) |
參數(shù)描述 |
|---|---|
| UPD16650N | 制造商:NEC 制造商全稱:NEC 功能描述:120-/128-OUTPUT TFT-LCD GATE DRIVER |
| UPD16650N-XXX | 制造商:NEC 制造商全稱:NEC 功能描述:Interface IC |
| UPD16652N-XXX | 制造商:未知廠家 制造商全稱:未知廠家 功能描述:LCD Display Driver |
| UPD16654 | 制造商:NEC 制造商全稱:NEC 功能描述:150/154 OUTPUT TFT-LCD GATE DRIVE |
| UPD16654N | 制造商:NEC 制造商全稱:NEC 功能描述:150/154 OUTPUT TFT-LCD GATE DRIVE |
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