參數(shù)資料
型號(hào)： TS83110MZ
元件分類(lèi)： ADC
英文描述： 1-CH 10-BIT PROPRIETARY METHOD ADC, PARALLEL ACCESS, CDSO28
封裝： CERAMIC, DFP-28
文件頁(yè)數(shù)： 11/16頁(yè)
文件大?。?/td> 550K
代理商： TS83110MZ
TS83110
4/16
Min.
Unit
Max.
Typ.
Test
level
Tamb
Symbol
Parameter
DYNAMIC CHARACTERISTICS
Transient response
Vin = 1.9 Vpp
TR
15
ns
Overvoltage recovery time
ORT
25
ns
Maximum clock frequency
FS
55
MSPS
Minimum clock frequency
FS
0.5
1
MSPS
Spurious Free Dynamic Range
SFDR
FS = 50 MSPS ; FIN = 10 MHz
60
dB
FS = 40 MSPS ; FIN = 20 MHz
58
dB
Power Supply Rejection Ratio
PSRR
TBD
mV/V
Signal to noise ratio
FS = 50 MSPS, FIN = 10 MHz
FS = 40 MSPS, FIN = 20 MHz
SNR
54
51
dB
Total harmonic distorsion
FS = 50 MSPS, FIN = 10 MHz
FS = 40 MSPS, FIN = 20 MHz
THD
60
49
dBc
Signal to noise and distorsion ratio
FS = 50 MSPS, FIN = 10 MHz
FS = 40 MSPS, FIN = 20 MHz
SINAD
53
47
dB
Effective number of bits
FS = 50 MSPS, FIN = 10 MHz
FS = 40 MSPS, FIN = 20 MHz
ENOB
8.5
8
bits
Dual tone intermodulation
(Fin1 = 9.9 MHz@1/2 FS
(Fin2 = 10.1 MHz@1/2 FS)
IMD
63
dB
Bit Error Rate
FS = 40 MSPS, FIN = 10 MHz
Output error >
±16 LSB
BER
10–10
error/
sample
POWER REQUIREMENTS
Power supply
AVcc
DVcc
full
4.75
5
5.25
V
Power dissipation Normal mode
Nap mode
190
40
TBD
mW
THERMAL RESISTANCES
SOIC 28 (plastic)
Junction to ambient
Junction to case
qJA
qJC
57
10
°C/W
CDFP 28 (ceramic)Junction to ambient
Junction to case
qJA
qJC
56
13
°C/W
Note :
Analog input range (offset only) can be adjusted using VREF input : VREF – 0.5 V < VIN < VREF + 0.5 V ; 2.3 V <VREF< 3.3 V
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PDF描述
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