參數(shù)資料
型號(hào)： TPS72516KTTR
廠商： Texas Instruments, Inc.
英文描述： LOW INPUT VOLTAGE, 1-A LOW-DROPOUT LINEAR REGULATORS WITH SUPERVISOR
中文描述： 低輸入電壓，1低壓差線性穩(wěn)壓器與督導(dǎo)員
文件頁數(shù)： 3/22頁
文件大?。?/td> 698K
代理商： TPS72516KTTR
www.ti.com
Line regulation (mV)
% V
VO5.5 V
VImin
100
1000
PACKAGE DISSIPATION RATINGS
ELECTRICAL CHARACTERISTICS
over recommended operating free-air temperature range V
I
= V
O(typ)
+ 1 V, I
O
= 1 mA, EN = IN, C
o
= 1 μF, C
i
= 1 μF (unless
otherwise noted)
TPS72501
TPS72515, TPS72516
TPS72518, TPS72525
SLVS341D–MAY 2002–REVISED MARCH 2004
PACKAGE
DDPAK
SOT223
D-8
BOARD
High K
(1)
Low K
(2)
High K
(1)
R
θ
JC
2
°
C/W
15
°
C/W
39.4
°
C/W
R
θ
JA
23
°
C/W
53
°
C/W
55
°
C/W
(1)
The JEDEC high-K (2s2p) board design used to derive this data was a 3-inch x 3-inch (7.5-cm x 7.5-cm), multilayer board with 1 ounce
internal power and ground planes and 2 ounce copper traces on top and bottom of the board.
The JEDEC low-K (1s) board design used to derive this data was a 3-inch x 3-inch (7.5-cm x 7.5-cm), two-layer board with 2 ounce
copper traces on top of the board.
(2)
PARAMETER
Bandgap voltage reference
TEST CONDITIONS
MIN
1.177
TYP
1.220
MAX
1.263
UNIT
V
TPS72501
Adjustable
0 μA < I
O
< 1 A
(1)
1.22 V
≤
V
O
≤
5.5 V
0.965 V
O
1.035 V
O
T
J
= 25
°
C
0 μA< I
O
< 1 A
T
J
= 25
°
C
0 μA < I
O
< 1 A
T
J
= 25
°
C
0 μA < I
O
< 1 A
T
J
= 25
°
C
0 μA < I
O
< 1 A
I
O
= 0 μA
I
O
= 1 A
EN < 0.4 V
EN < 0.4 V
BW = 200 Hz to 100 kHz,
T
J
= 25
°
C
f = 1 kHz, C
o
= 10 μF
1.5
TPS72515
1.8 V
≤
V
I
≤
5.5 V
1.47
1.53
1.6
TPS72516
V
O
Output voltage
V
2.6 V
≤
V
I
≤
5.5 V
1.568
1.632
1.8
TPS72518
2.8 V
≤
V
I
≤
5.5 V
1.764
1.836
2.5
TPS72525
3.5 V
≤
V
I
≤
5.5 V
2.45
2.55
120
300
75
I
Ground current
μA
210
0.2
T
J
= 25
°
C
Standby current
μA
1
C
o
= 10 μF, I
O
= 1
mA
T
J
= 25
°
C
V
n
Output noise voltage
150
μV
PSRR
Ripple rejection
Current limit
(2)
Output voltage line regulation
(
V
O
/V
O
)
(3)
Output voltage load regulation
EN high level input
(2)
EN low level input
(2)
EN input current
Feedback current
UVLO threshold
UVLO hysteresis
UVLO deglitch
UVLO delay
60
1.6
dB
A
1.1
2.3
V
O
+ 1 V < V
I
≤
5.5 V
-0.15
0.02
0.15
%/V
0 μA < I
O
< 1 A
-0.25
1.3
-0.2
0.05
0.25
%/A
V
IH
V
IL
I
I
I
(FB)
V
0.4
100
100
1.70
EN = 0 V or V
I
TPS72501
V
CC
rising
T
J
= 25
°
C, V
CC
rising
T
J
= 25
°
C, V
CC
rising
T
J
= 25
°
C, V
CC
rising
0.01
nA
nA
V
mV
μs
μs
V
(FB)
= 1.22
-100
1.45
1.57
50
10
100
(1)
(2)
(3)
Minimum IN operating voltage used for testing is V
+ 1 V.
Test condition includes output voltage V
= V
O
- 15% and pulse duration = 10 ms.
V
Imin
= (V
O
+ 1) or 1.8 V whichever is greater.
3
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