參數(shù)資料
型號(hào)： TLE6211
廠商： INFINEON TECHNOLOGIES AG
英文描述： ABS System IC
中文描述： ABS系統(tǒng)集成電路
文件頁數(shù)： 24/35頁
文件大?。?/td> 693K
代理商： TLE6211
TLE 6210
TLE 6211
Block Description and Electrical Characteristics
V1.2 Data Sheet
24
2002-08
The logic expects the time between two clock edges between 3 and 15 clock-cycles. If
this window is not met, the outputs VR, MR and NSILA are switched off, SILA is switched
on and the enable output goes low.
An internal counter ( see
Figure 12
) includes a 4 bit counter. Each time the value 15 is
reached a dominant counter reset signal is generated at the output "=15". This pulse is
generated continuously at
t = (15+3) T1 + n * (16*T1)
after the last valid watchdog pulse was detected.
When internal resets and watchdog edges occur at the same time, the internal reset is
dominant.
Figure 7
Missing watchdog signals cause EN low
1
0
1
0
1
0
15* t
CLK
+ Delay =
15* t
CLK
+ 3* t
CLK
10ms
WD1
WD2
EN
Delay (3* t
CLK
)
t > 16 *t
CLK
wd-controls-en-2
AD 04/02
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PDF描述
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