參數(shù)資料
型號(hào)： TLC3544CDWR
廠(chǎng)商： Texas Instruments, Inc.
英文描述： 5-V ANALOG, 3-/5-V DIGITAL, 14-BIT, 200-KSPS, 4-/8-CHANNELS SERIAL ANALOG-TO-DIGITAL CONVERTERS WITH 0-5 V (PSEUDODIFFERENTIAL) INPUTS
中文描述： 5 - V模擬，3-/5-V數(shù)字，14位，200 kSPS的，4-/8-CHANNELS串行模數(shù)位0-5五（擬微分）輸入變換器
文件頁(yè)數(shù)： 24/40頁(yè)
文件大?。?/td> 790K
代理商： TLC3544CDWR
TLC3544, TLC3548
5-V ANALOG, 3-/5-V DIGITAL, 14-BIT 200-KSPS, 4-/8-CHANNELS SERIAL
ANALOG-TO-DIGITAL CONVERTERS WITH 0-5 V (PSEUDODIFFERENTIAL) INPUTS
SLAS266C
–
OCTOBER 2000
–
REVISED MAY 2003
24
POST OFFICE BOX 655303
DALLAS, TEXAS 75265
operation timing diagrams
(continued)
1
2
3
5
4
6
7
13
14
15
16
1
ID15
1D14
ID13 1D12
INT
ììììììììììììììììì
ììììììììììììììììì
12
ID15
ìììì
ìììì
ID14
ID11
ID10
ID9
ID4
ID3
ID2
ID1
ID0
ìììììììì
ìììììììì
OR
ììì
Figure 10. Write Cycle, CS Initiates Operation, FS = 1
Don
’
t Care
CS
FS = High
SDI
EOC
SDO
Hi-Z
FIFO Read Operation:
When the FIFO is used, the first command after INT is generated is assumed to be the
FIFO read. The first FIFO content is sent out immediately before the command is decoded. If this command is
not a FIFO read, the output is terminated. Using more layers of the FIFO reduces the time taken to read multiple
conversion results, because the read cycle does not generate an EOC or INT, nor does it make a data
conversion. Once the FIFO is read, the entire contents in the FIFO must be read out. Otherwise, the remaining
data is lost.
ììì
INT
1
2
3
5
4
6
7
13
14
15
16
1
ID15
1D14
ID13
1D12
OD11 OD10
OD9
OD4
OD3
OD2
12
ID15
ID14
OD15 OD14 OD13 OD12
OD15
ìììì
ìì
OD14
OR
Notes:
Signal May Not Exist.
OD[15:2] is FIFO Contents.
SCLK
CS
FS = High
SDI
EOC
SDO
ìì
ìì
Figure 11. FIFO Read Cycle, CS Initiates Operation, FS = 1
Don
’
t Care
Hi-Z
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PDF描述
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參數(shù)描述
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